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二维DCT算法的高速芯片设计 总被引:8,自引:0,他引:8
介绍了一种基于行列变换快速算法的高速DCT处理芯片的设计,并详细阐述了实现这一算法的电路结构.为了提高芯片的处理速度,电路中采用了流水线结构和双RAM转置存储技术,并给出FPGA实现和Verilog综合结果.综合结果显示,该芯片最高可以工作在140MHz的时钟频率上,非常适合于各种视频图像压缩方面的实时应用. 相似文献
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对多媒体数据压缩领域内的主要的工作方法和机制进行了比较和分析,同时也对这些领域将来的发展方向进行探讨。 相似文献
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介绍了针对大型金相显微镜设计的远程监控系统。该系统通过广域网传输监控信号,利用微机和单片机实现对金相显微镜的远程监控。同时,提出了动态适应性编码方法,从而很好地协调了传输速度和传输数据量之间的矛盾,实现了视频数据的实时传输。 相似文献
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高清视频数据量大给视频传输和存储带来困难,单纯增大带宽和存储容量已不现实。依据H.264视频压缩标准原理和TI高性能Davinci处理器特性,设计了基于DM6467的DSP(/ARM)+FPGA架构的高清视频压缩实时显示和存储硬件平台,并给出了H.264压缩算法实现方法。通过对视频序列进行验证,仿真结果表明,在峰值信噪比较高时,仍能得到约20倍的压缩比,同时具有良好的实时性。 相似文献
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本文提出了一种缓存反馈控制的改进算法,并把它用于CCITT H.261(简称为H.261)建议的低速率视频压缩编码器的设计中,本文还对算法在实现中所遇到的问题进行了综合考虑,并与基本的BOC算法进行了比较。计算机模拟结果表明,本文提出的算法的效果更好,且未给实现增加复杂度, 相似文献
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《中国新技术新产品精选》2008,(13):9-9
ATtiny167器件应用汽车联网LIN Networking;F-RAM产品首款器件FM25V10上市;全新视频压缩格式问世. 相似文献
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由于利用TMS320C6000系列的DSP底层结构可以提高图像压缩的实时性,本文在TMS320C6416平台上针对DSP底层结构对MPEG-4视频编码进行了优化,包括对8个运算单元能并行执行的特性进行汇编。针对DSP芯片两级高速缓存的工作特点,对编码器中代码和数据所占用的内存空间进行优化。利用EDMA级联特性在内存开辟双缓冲区,同时完成视频数据编码和传输的工作,从而有效地改善编码效率。实验结果表明:该编码器可以对512 pixel×512 pixel大小的灰度图像,以30 frame/s帧频进行压缩,实现了对视频图像的实时编码。 相似文献