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为了减小传统的最差情况设计方法引入的电压裕量,提出了一种变化可知的自适应电压缩减(AVS)技术,通过调整电源电压来降低电路功耗.自适应电压缩减技术基于检测关键路径的延时变化,基于此设计了一款预错误原位延时检测电路,可以检测关键路径延时并输出预错误信号,进而控制单元可根据反馈回的预错误信号的个数调整系统电压.本芯片采用SMIC180 nm工艺设计验证,仿真分析表明,采用自适应电压缩减技术后,4个目标验证电路分别节省功耗12.4%,11.3%,10.4%和11.6%. 相似文献
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从硬件和软件两个角度出发,介绍基于DSP的多元数据同步采集与存储系统的组成、工作模式以及功能的测试。系统主要由上位机和数字采集与存储单元组成,其中数字采集与存储单元的硬件部分包括电源模块,值班电路模块,数据采集模块,数据存储模块,时钟同步模块。系统采用DSP作为中央处理芯片,利用经过同步后的秒脉冲作为触发信号,实现同步数据采集。以CF卡作为存储介质,实现数据自容式存储。软件部分实现自检、同步、数据采集存储功能。经过测试,系统工作稳定,功能正常,同步精度在100ns以内。 相似文献
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本文介绍了一种基于VXI总线,共享存储器的Flash ROM在线烧写方法,阐述了系统的功能,并给出了系统的硬件组成和软件设计。 相似文献
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基于SONET/SDH的存储网络容灾技术分析 总被引:1,自引:0,他引:1
吴丽征 《微电子学与计算机》2006,23(6):119-122
文章分析了存储网络(SAN)容灾技术,认为在某些企业中,数据是至关重要的资产之一,是业务系统运行的血脉.保护企业的重要数据是企业成功的关键因素。文章讨论了设计容灾技术解决方案应考虑的各种因素,并给出了基于SONET/SDH的存储网络技术的体系架构设计方案。 相似文献
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