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文章设计了一种低压、恒定增益、Rail-to-rail的CMOS运算放大器。该放大器采用直接交迭工作区的互补并联输入对作为输入级,在2V单电源下,负载电容为25pF时,静态功耗为0.9mW,直流开环增益、单位增益带宽、相位裕度分别为74dB、2.7MHz、60°。 相似文献
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为减小脉冲关断延迟,提出了一种用于数字峰值电流模Buck的高精度数字脉冲宽度调制器(DPWM)的设计方案。采用粗调与细调相结合的分段式架构思想,粗调部分由全局时钟控制计数器-比较器模块构成,细调部分由锁相环组成的相移电路、计数器-比较器、多路选择器和逻辑门构成,以此产生不同精度的两段式延迟叠加,实现较高的DPWM输出精度。采用Vivado和Xilinx7系列FPGA,仿真并测试了搭载高精度DPWM的Buck。仿真结果表明,DPWM时间分辨率为250 ps,精度为0.01%。此外,测试结果表明,与低精度DPWM相比,设计的高精度DPWM一定程度上抑制了系统的极限环振荡,提高了Buck的环路带宽及系统稳定性。 相似文献
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本文研究了采用质子交换与退火工艺相结合所制作的LiNbn_3波导的特性。用WKB法测量了折射率分布剖面,并提出一种新的两棱镜法测量了波导损耗。结果表明:质子交换与退火工艺相结合,可使LiNbo_3波导的表面折射率降低0.0363,波导层向衬底内扩展,折射率剖面变为渐变形,同时损耗降低到0.4dB。 相似文献
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设计了一种集成双半桥和四功率开关的驱动芯片。采用双路对称设计,每一路可单独控制使能、自举和驱动。芯片内部采用高精度的基准源以及LDO电路,同时具有欠压死锁、过压保护和过温保护功能。死区控制可避免上下功率管直通大电流,自举设计可使上功率管的开启电压达到5 V,降低了功率管自身的损耗,使功率管输出达到11.90 V。采用TSMC 0.18μm BCD工艺进行流片。测试结果表明,输出的方波信号幅度为11.96 V/11.95 V,死区时间为60 ns/80 ns,静态功耗低至478μA。 相似文献
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设计并实现了一种高功率因数AC-DC LED驱动电路。采用单周期控制策略与固定关断时间控制方式,得到了接近于1的功率因数。针对系统工作在断续导通模式下所产生的输入电流零交越畸变现象,加入了零交越补偿电路,并对改进的电路进行系统建模。使用Simplis软件验证了该策略的可行性,并对补偿电路进行了参数优化与选取。采用HHNEC 0.5 μm 5 V/40 V HVCMOS工艺对芯片进行MOS级电路设计,控制芯片版图尺寸为1 950 μm×2 730 μm。对原型电路进行测试,交流输入电压在85~265 V范围内,输出功率在7~12 W时,整个系统功率因数高于0.98,最高可达0.9992,总谐波失真最小仅为4.67%。 相似文献
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设计并实现了一种动态补偿、高稳定性的LDO.针对LDO控制环路稳定性随负载电流变化的特点,给出一种新颖的动态补偿电路.这种补偿电路能很好地跟踪负载电流的变化,从而使控制环路的稳定性几乎与负载电流无关.设计采用CSMC 0.5μm标准CMOS工艺,利用Cadence的EDA工具完成电路设计、版图绘制和流片测试,最终芯片面... 相似文献
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