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1
1.
超前进位加法器的一种优化设计
总被引:1,自引:0,他引:1
黄舒怀
蔡敏
《半导体技术》
2004,29(8):65-68
描述了超前进位加法器的一种优化设计.在结构上采用按4位分组进行超前进位的方法达到并行、高速的目的.为了在高速运算的同时降低功耗,对求和式子进行了逻辑变换;在晶体管级进行优化的单元电路设计,可减小延时、降低整个电路的面积和功耗.
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