10bit 100M低功耗时间交织运放共享模数转换器设计

本文设计了一个应用于3G接收机中频的10比特100兆采样率的双通道时间交织流水线模数转换器,为了降低功耗,运放在两通道间共享。针对通道间的直流失调失配,增益失配以及采样时间偏差,设计分别采用共享运放,增加每个通道转换精度以及全局采样技术来加以解决。通过改变时序,消除了输出开关电荷注入以及断开开关的电容造成的串扰,从而提高了整个模数转换器的线性度。整个模数转换器的供电电压为3.3V,功耗为70毫瓦,采用了180纳米CMOS工艺,面积为3×2mm2,在奈奎斯特频率以内,其杂散无失真动态范围大于70dB,其信杂比大于56dB。     

低功耗12b 40M流水线模数转换器

本文介绍了一个12b 40M流水线模数转换器（ADC）,在0.18um CMOS工艺下流片,工作电压3.3V,功耗76mW。为了实现功耗优化,流水线各级采用了多比特结构和套筒式运算放大器。模数转换器的前两级采用3比特/级结构,以提高转换器线性度。该模数转换器不需要校正,经测试DNL小于0.51-LSB,INL小于1LSB。当模数转换器工作在40MHz采样率时,在奈奎斯特频率以内,SNDR指标大于67dB;在49MHz以内的输入信号频带内,SFDR指标在80dB左右,变化幅度不超过1-dB。     

10位100MSPS 70 mW双通道交织流水线A/D转换器

设计了应用于3G无线通信中频接收机的10位100 MSPS双通道交织流水线A/D转换器,采用0.18μm CMOS工艺流片.电路工作电压为3.3 V,核心部分功耗不超过70 mW.为了减小A/D转换器的功耗,采用两路并行交织结构,并在两个通道间进行运放共享.运放采用套筒式结构,以进一步节省功耗.对于交织结构,如何保证线性度是设计的关键.线性度主要受直流失调失配、增益失配及采样时间失配的限制.分别采用共享运放、提高每个通道的精度,以及全局被动采样(Global Passive Sampling),减小这些失配的影响.除通道间失配外,还分析了传统双采样电路中的输出开关电荷注入以及断开开关电容串扰对线性度的影响.为了保证A/D转换器的线性度,通过修改时序,消除了以上开关的非理想因素.后仿真结果表明,在100 MsPS采样率下,输入信号带宽为47.6 MHz;最差工艺角(ss,120℃)下,杂散无失真动态范围(SFDR)大于70 dB,信杂比(SNDR)大于60 dB.     

A 10-bit 100-Msps low power time-interleaved ADC using OTA sharing

A high performance 10-bit 100-MS/s two-channel time-interleaved pipelined ADC is designed for intermediate frequency 3G receivers,and OTA is shared among the channels for low power dissipation.Offset mismatch, gain mismatch and time skew mismatch are overcome by OTA sharing,increasing the accuracy of each channel and global passive sampling respectively.The linearity deterioration caused by the charge injection of the output switch and the crosstalk of the off-switch capacitor is removed by modifying the...