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分析了流水线A/D转换器采样电容与反馈电容之间的增益失配,探究了运放有限增益与流水线残差输出及A/D转换器输出的关系,建立了精确的系统模型。通过建立14位流水线A/D转换器Verilog-A的行为级模型,在数字域对流水线A/D转换器输出数字码进行分段平移。在第一级级间增益误差达到±0.012 5时,校正前信噪比仅为62 dB,校正后信噪比提升到85 dB。提出的校正方法可有效补偿由流水线级间增益导致的数字输出不连续和线性度下降。 相似文献
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设计并实现了一种14位50 MS/s流水线ADC。采用无采保放大器的前端电路和运放共享技术,在达到速度及精度要求的同时降低了功耗。该流水线ADC采用0.13 μm标准CMOS工艺实现,芯片尺寸为2.7 mm×2.1 mm。在电源电压为1.2 V、采样速率为50 MS/s、模拟输入信号频率为28 MHz的条件下进行测试。结果表明,该ADC的功耗为91.2 mW,SFDR为82.39 dBFS,SNR为72.45 dBFS,SNDR为71.13 dB,ENOB为11.52 bit,THD为-81.28 dBc,DNL在±1 LSB以内,INL在±3 LSB以内,品质因子FOM为0.62 pJ/step。 相似文献
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摘 要:通过数字化和智能化实现自动化管理已成为千行百业削减运维成本的关键技术。作为数字化和智能化的“赋能者”,5G 移动通信系统已经从早期的人工运维网络演进到人工协助的自动运维网络。在研究 5G网络自动化技术的基础上,重点分析了3GPP提出的L0~L5自治网络等级,深入探讨了包含意图全生命周期维护和意图冲突管理等若干意图驱动的5G自治网络关键技术。最后,提出了一个意图驱动的5G自治网络落地实践方案:意图驱动的业务体验保障方案。 相似文献
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