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161.
针对目前空间遥感器主支撑结构设计中难以同时保证光学元件刚度大、尺寸热稳定性好的问题,提出了一种具有柔性环节的支撑结构,有效地解决了影响基于空间环境的一种光栅光谱仪成像质量的力、热两个关键环境约束之间的矛盾。根据光学设计指标要求确定了光栅基板的结构形式,通过理论计算对柔性支撑的尺寸参数进行了灵敏性分析,得到了各尺寸对转角刚度的影响权重。通过优化柔性支撑件尺寸参数使光栅组件性能达到最优,利用有限元分析(FEA)软件对光栅组件在力、热耦合作用下的面形精度和动态刚度进行了仿真分析。结果表明,光栅及其支撑结构设计合理,满足空间应用要求,为柔性支撑的深入研究和应用提供了参考。 相似文献
162.
在研究了JEDEC制定的DDR2标准的基础上,基于对DDR2快速测试的目的,设计了一种带自测功能的新型DDR2控制器。该控制器既拥有常见的控制时序、刷新、初始化等功能,又可以在没有外部激励的情况下对DDR2进行测试。整个设计完全遵循JEDEC标准,采用自顶向下的设计方法,通过异步FIFO进行跨时钟域的信号通讯,接口部分兼容FPGA的MCB模块,可以实现和MCB的简单替代,最后用verilog语言进行描述并通过仿真验证和FPGA验证.达到了较高的性能和实现了要求的功能。与常见的控制器相比,本设计虽然增加了自测试功能,但综合后的面积只增加10%。 相似文献
163.
描述了在TD-LTE网络的场景中PTN核心层L3网络的组网架构和组网思路.首先介绍了TD-LTE无线网的承载要求;其次,分析了目前主流的PTN3层功能和PTN+CE的承载网络架构及PTNL3网络的组网思路;最后,分析了城域网PTNL3网络的相应演进方式,为今后网络的发展提供了一定的借鉴. 相似文献
164.
165.
In this paper, we propose new universal designs of ternary-valued logic (TVL) with high-speed, low-power and full swing output using carbon nanotube FETs (CNTFETs). All of the TVL functions (39 functions) can be implemented in these designs. Ternary value logic is a promising alternative to binary logic due to the reduced integrated circuit (IC) interconnects and chip area. Therefore, a universal design of TVL is a good direction for the future of FPGA design using CNTFET. In this paper, new universal designs of ternary-valued logic based on CNTFETs are proposed and compared with the existing resistive-load CNTFET universal TVL designs. Extensive simulations have been performed in HSPICE to investigate the distribution of power consumption and the delay of the CNTFET-based universal cells due to variations in the supply voltage, the diameter of the CNT, and the room temperature. Simulation results show that the proposed universal TVL designs result in significantly lower power consumption and delay compared with previous resistive-load CNTFET universal TVL implementations. 相似文献
166.
我国的公共照明设备的电能源浪费现象非常严重,以学校图书馆借阅室的照明灯为例,几乎常年、整天的照明造成大量的电能源浪费。结合电子专业的技术知识,通过设计电路图以及对电路图的仿真,并应用相关电子元器件,设计出一个节能控制电路,根据当日的光照水平和阅览室内学生人数,决定照明灯的开关,实物运行效果良好。 相似文献
167.
168.
Shu-Chung Yi Jin-Jia Chen Chien-Hung Lin Kun-Tse Lee 《International Journal of Electronics》2013,100(6):593-599
This work presents a low power direct digital frequency synthesiser (DDFS) by using a new two-level lookup table algorithm. The algorithm uses trigonometric double angle formula to divide lookup table ROM into two parts. The ROM size of the proposed architecture is 25% less than that of conventional lookup table DDFS. The hardware of new DDFS architecture compared to the traditional two-level table DDFS also requires less one multiplication. A synthesised 0.35 µm DDFS with an spurious free dynamic range of ?80 dB, runs up to 100 MHz and consumes 81 mW at 3.3 v. The power efficiency is 0.81 mW MHz?1, which represents an enhancement of more than 38% compared to the conventional DDFS. 相似文献
169.
为有效提高雷达系统仿真效率,本文提出了一种雷达信号处理模块组件化设计方法。所提方法首先根据雷达信号处理各流程的独立性建立信号处理功能组件库;在此基础上根据所仿真雷达对象进行组件的选择与拼接可灵活构建出所需信号处理模块。最后通过基于Visual Studio 2013平台中构建的雷达组件化信号处理模块的系统试验证明了所提方法的有效性。 相似文献
170.