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An analog front‐end circuit for ISO/IEC 14443‐compatible radio frequency identification (RFID) interrogators was designed and fabricated by using a 0.25 µm double‐poly CMOS process. The fabricated chip was operated using a 3.3 Volt single‐voltage supply. The results of this work could be provided as reusable IPs in the form of hard or firm IPs for designing single‐chip ISO/IEC 14443‐compatible RFID interrogators. 相似文献
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运用回转器一电容模型可以很好的理解磁性器件,特别是复杂的集成磁件。文章运用磁导电容类比建模法建立了磁件的回转器一电容模型。在回转器一电容模型中,磁路由容性电路来模拟,绕组由双端口的回转器来代替。进行了采用磁集成技术的低压大电流DC/DC变换器的仿真。仿真电路拓扑是原边不对称半桥、副边倍流整流电路。磁集成变压器的结构是Wei Chen提出的原边绕于中柱的只在侧柱开气隙的倍流整流磁集成结构。建立了用SPICE语言描述的回转器仿真模型。仿真软件是MULTISIM2001。 相似文献
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铝基印制电路板制造工艺研究 总被引:1,自引:0,他引:1
此文对一种进口铝基印制电路板的制造工艺流程进行了介绍,对所采用的制造工艺技术进行了较为详细的论述。 相似文献
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用新的电路形式提高HBT光调制器驱动电路的传输速率及性能 总被引:1,自引:1,他引:0
在传统光调制器驱动电路中,所用HBT截止频率的大小要达到驱动电路传输速率的4倍以上.文中在输出级采用共射共基HBT形式后,其器件的截止频率只需大于电路传输速率的2倍即可,从电路设计的角度降低了对所用器件的要求.文中分析了新的电路结构提高传输速率的原因并给出了模拟结果.同时新的电路结构也具有良好的热稳定性. 相似文献
137.
一种高并行度的H.264帧内预测器的VLSI设计 总被引:3,自引:2,他引:1
分析了帧内预测的17种模式,对于每个4×4大小块的16个像素点的不同模式的预测公式之间的相同运算,采用数字强度缩减的方法去除计算的冗余,提出了一种高并行度的帧内预测器,可以每个时钟周期处理16个像素点的预测值。基于SMIC0.18μm工艺,用verilog对该设计进行了VLSI实现,综合后的电路的关键路径最大时延为10ns,电路规模不超过1.4万门,数据吞吐率可以达到1600Msamples/s。从实现结果来看,与采用可重构方法的设计相比,该设计在相同的并行度下减小了电路面积,简化了控制逻辑。 相似文献
138.
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集成电路的现状及其发展趋势 总被引:5,自引:0,他引:5
集成电路是信息社会经济发展的基石。通过对集成电路发展规律的分析,从集成电路的设计、制造、新产品研发和市场动态等方面,描述了集成电路的最新动态;探讨了集成电路的发展趋势;指出集成电路与其它学科、技术的结合,不断形成新的研究方向;新材料、新结构、新器件不断涌现,特征尺寸继续缩小,摩尔定律仍然起作用。 相似文献
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