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设计了一个多通道逐次逼近型结构的10 bit 40 Ms/s模数转换器(ADC).由于采用时间交叉存取技术,提高了整个芯片的转换速度,同时通过运用比较器自校准和电容自校准结构,提高了整个电路的转换精度.本芯片采用Chart 0.25μm2.5 V工艺,版图面积为1.4 mm× 1.3 mm.40 MHz工作时,平均功耗为33.68 mW.输入频率19.9 MHz时,信号噪声失真比(SINAD)为59.653 3 dB,无杂散动态范围(SFDR)为74.864 6 dB. 相似文献
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基于CSMC0.5umCMOS工艺设计一种带滞回功能的高稳定性电压控制电路,利用迟滞比较器对旁路电压和基准电压进行比较并控制电容的充放电,提高了电压的稳定性。Cadence Spectre仿真结果表明,该电路产生的电压稳定性高,功耗低,且其滞回功能能有效抑制噪声。与普通的旁路电压控制电路相比,具有更高的稳定性和抗噪声能力,可广泛用于各种功率放大器内部。 相似文献
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基于预防大锁存理论,设计了一款带有三级前置运算放大器和latch再生电路的高精度比较器.为了实现高精度,采用了输入失调储存(IOS)和输出失调储存(OOS)级联的消失调方法,有效降低了比较器的输入失调电压.传统的比较器动态失调测试方法非常耗时,为此采用新的带负反馈网络的动态失调测试电路,从而大大提高了比较器的设计和仿真效率.Hhnec CZ6H(0.35μm)工艺下,仿真表明,比较器能够分辨的最小信号为33.2μV,满足14 bit SAR ADC对比较器的性能要求. 相似文献
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