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251.
并行交替采样系统的性能依赖于各通道的精确配合,相对于传统单通道采样系统,其面临更多的系统误差源.未补偿的失配误差将导致采样波形非线性失真、输出信噪比降低以及无伪峰动态范围损失等.本文提出了一种新的并行交替采样系统误差校正方法,在频域利用相邻频率点输出矢量对应信号子空间的旋转关系和正交投影矩阵的唯一性,实现增益误差以及时基误差的精确估计.该方法无需迭代,估计精度较高,对噪声以及偏置误差稳健,并且可以同时完成信号重构.仿真数据的处理结果验证了本文方法的有效性. 相似文献
252.
充分利用多核结构的共享三级缓存、私有二级和一级缓存,将采用Modeling算法求解(l,d)-Motif发现问题过程中产生的大量不同位置组合的数据,以多轮方式调度分配到各级缓存中,通过线程绑定以平衡核心负载,设计实现了一种访存高效的(l,d)-Motif发现线程级并行算法.实验结果表明,与已有的并行求解(l,d)-Motif发现算法相比,本文给出的算法更高效、具有较好的加速比和可扩展性,并且能够成功求解更长l的(l,d)-Motif发现问题. 相似文献
253.
针对无线传感器网络的特点,提出一种适于FPGA实现的改进的AES-ECC混合加密系统。本方案采用AES模块对数据进行加密,用SHA-1加密算法处理数据得到数据摘要,用ECC加密算法实现对摘要的签名和对AES私钥的加密。各个算法模块采用并行执行的处理方式以提高运算效率。方案优化了AES加密模块的设计,在占用相对较少逻辑资源的同时提高了系统吞吐率,通过优化ECC乘法单元的设计,提高了数字签名生成和认证的速度,完全满足了无线传感器网络对于稳定性、功耗以及处理速度的要求,给数据传输的安全性提供了高强度的保障。 相似文献
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255.
256.
真值表是表征逻辑输入与输出之间因果关系的重要工具,真值表约简在数字逻辑电路的分析与设计中具有重要意义.该文将真值表看作逻辑信息系统,将真值表约简转化为逻辑信息系统的最简规则获取.采用粒计算分层粒化的思想,在不同粒度下,利用粒矩阵的知识表示形式、粒矩阵中的启发式知识以及粒矩阵运算,设计了多输入多输出真值表快速并行约简算法.以发光二极管七段数字显示器为例进行了算法说明,通过数学证明和算法复杂性分析证明了算法的正确性和有效性. 相似文献
257.
258.
259.
相关干涉仪测向技术在工程中应用很广泛,但是庞大的计算量严重影响了测向响应时间。利用数字信号处理器(DSP)的并行流水编程技术和同步接口的直接存储器访问技术(DMA)可以较好的解决处理速度问题。介绍了基于汇编语言的并行流水编程和同步接口DMA两种关键技术,从相关度计算的并行流水编程和DMA方式导入样本相位差两方面论述了快速实现方法的步骤,对该方案的处理速度进行了分析。 相似文献