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模拟分析滤波器组的实现欠理想、系统噪声以及数字综合滤波器有效阶数实现所带来的系统误差均有可能造成混合滤波器组的设计出现解不稳定、无唯一解等病态问题,影响混合滤波器组的准确重构效果。本文首先给出了满足准确重构条件下,以综合滤波器组频域响应为求解变量的混合滤波器组线性求解模型。针对线性方程中系数矩阵以及目标向量受扰动误差影响特点,提出一种新的基于加权总体最小二乘正则化算法的IIR形式综合滤波器设计方法。算法以系统扰动误差最小化为目标函数,根据随机误差变量的二阶统计特性,采用加权总体最小二乘算法抑制滤波器实现误差以及随机噪声等扰动因素影响,使得到的综合滤波器组频域响应解的加权误差平方和最小化,并通过Tikhonov正则化方法优化病态情况下方程组解的稳定性。提出一种IIR类型的综合滤波器系数的求解算法,并利用正则化方法优化滤波器系数,提高系统稳定性。该方法可应用于过采样混合滤波器组的设计。仿真结果表明该算法的有效提高系统鲁棒性和改善重构性能。 相似文献
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芯片级原子钟主要包括射频模块、物理封装模块以及其他的外围控制模块。射频模块的设计关系到芯片级原子钟的短期稳定度,所以射频模块在芯片级原子钟的设计时是非常重要的一部分。本文利用数字锁相环技术实现频率为4.596 GHz的射频源,射频源由三部分组成,包括小数分频频率综合器、压控振荡器和环路滤波器。数字锁相环具有相位噪声低,频谱稳定度高等特点。此外,由于小数分频频率综合器是可编程的,可以通过配置N分频器与R分频器实现输出频率的快速扫描。与此同时,根据相关公式,可以计算出三阶无源环路滤波器的近似参数值,所设计的环路滤波器具有300 kHz的环路带宽以及55的相位裕度。最后,整个基于数字锁相环技术实现的射频源通过仿真、硬件实现以及测试。测试结果显示,射频源的相位噪声为-74.02 dBc/Hz@300 Hz,符合芯片级原子钟射频源的设计要求。 相似文献
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