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902.
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根据在保持电路原有性能的前提下可通过降低时钟频率来降低系统功耗的原理和双边沿触发器的设计思想,本文将多值信号信息量大的优点应用于时钟网络上设计了基于三值时钟的四边沿触发器,消除了三值时钟的冗余跳变,从而通过降低时钟频率的方式达到降低功耗的目的。本文设计的四边沿触发器电路结构简单,既可以用于二值时序电路中也可以用于多值时序电路中。模拟结果表明,本文设计的四边沿触发器具有正确的逻辑功能且能有效地降低系统功耗。 相似文献
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为产生一个与视频信号中的行同步信号严格同步的时钟信号,设计了一种数模混合结构的电荷泵锁相环(PLL)电路。通过对锁相环电路中鉴频鉴相器、电荷泵电路、振荡器电路设计适当改进,实现了性能稳定的时钟信号。采用中芯国际公司的0.35μm 2P4M双层多晶硅四层金属3.3 V标准CMOS工艺,使用Simulink软件进行了系统级仿真、Spectre软件进行了电路级仿真、Hsim软件进行了混合仿真。结果表明,环路输出频率27 MHz时钟信号,占空比达到50.141%,输入最大2 Gbit/s像素信号条件下,时钟抖动小于350 ps,锁定时间小于30μs,芯片的工作达到设计要求。 相似文献
907.
数字系统设计要求考虑使用多个核心电压。存储器工作在1.8V,I2C和FPGA器件的工作电压为3.3V,微控制器工作在5V,而电荷耦合器件图像传感器则需要-9V~8V的工作电压。每种器件的时钟必须适应于其工作电压。可以用下图中的电平转换电路,将输入时钟信号调整到适当的逻辑高和逻辑低电平,包括负电压。这种特性对于需要负电压的器件很方便,如电荷耦合器件传感 相似文献
908.
作为一家专注于提供全硅MEMS时钟方案以取代传统石英产品的模拟半导体芯片公司,SiTime目前已经在MEMS时钟市场占据85%的份额,总发货量达到7500万套,SiTime相信凭借其独有的MEMS时钟技术将在价值50亿美元的时钟市场更快的实现普及。 相似文献
909.
192kHz取样和352.8kHz取样的声源已经普及,用户也很容易购买到,因此用户需要能与之相适应的高音质传输系统。本文介绍能适用于192kHz数字音频信号的抖动降低器和能降低345kHz取样数字音频信号时钟抖动的I2S传输系统的有关情况。一、隔离变压器NS-UT01前一回所介绍的DSIX(Digital SignalIsolation eXciter;数字信号绝缘激励器)是 相似文献
910.
探讨和分析了时钟同步网指标和移动基站指标,结合本地网时间指标的分析,尝试给出了IP环境下同步网模型和指标分配。讨论的重点是时钟同步网,并在一定程度上论述了时间同步网。 相似文献