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11.
12.
基于改进遗传算法的布局优化子问题 总被引:2,自引:0,他引:2
本针对子问题,构造了布局子问题(关于同构布局等价类)的改进遗传算法。将该算法应用于二维布局优化子问题,数值实验表明该算法能够在很好地保持图元的邻接关系的前提下找到子问题的最优解。由于布局优化问题可分解为有限个子问题,所以利用该算法可以找到整个布局优化问题的全局最优解。 相似文献
13.
本文介绍了EltctronicWorkbench软件和计算机虚拟仪器系统,采用计算机模拟仿真技术对电子线路实验加以辅助设计和探索。 相似文献
14.
Using the path integral method we derive quantum wave function and quantum fluctuations of charge andcurrent in the mesoscopic RLC circuit. We find that the quantum fluctuation of charge decreases with time, oppositely,the quantum fluctuation of current increases with time monotonously. Therefore there is a squeezing effect in the circuit.If some more charge devices are used in the mesoscopic-damped circuit, the quantum noise can be reduced. We also findthat uncertainty relation of charge and current periodically varies with the period π/2 in the under-damped case. 相似文献
15.
设计一种用归零码及多重相关解调技术的传输方案,并给了所需的几种抗干扰单元电路,最后结合实验说明了此方案可提高不良环境下传输数据的置信率。 相似文献
16.
R. Thomas conjectured, 20 years ago, that the presence of a positive circuit in the interaction graph of a dynamical system is a necessary condition for the presence of several stable states. Recently, E. Remy et al. stated and proved the conjecture for Boolean dynamical systems. Using a similar approach, we generalize the result to discrete dynamical systems, and by focusing on the asynchronous dynamics that R. Thomas used in the course of his analysis of genetic networks, we obtain a more general variant of R. Thomas’ conjecture. In this way, we get a necessary condition for genetic networks to lead to differentiation. 相似文献
17.
通过保持非耗散介观LC电路的固有频率不变,而使电路参数作阶跃函数变化,就可将介观LC电路由初始的偶相干态制备到压缩偶相干态;在压缩偶相干态下,介观电路系统不仅有非经典的量子压缩效应,而且有非经典的反聚束效应.
关键词:
介观LC电路
单位阶跃函数
压缩算符
压缩偶相干态 相似文献
18.
本基于对风险项目及其“孪生证券”风险和收益特性的分析,认为真正的“孪生证券”实际中很难存在,进而提出利用“近似孪生证券”与无风险证券构造资产组合来复制实物期权收益特征,利用无风险套利分析确定项目实物期权价值的方法。但考虑到管理人因素造成的实物期权内部风险特征的不可复制性,本进一步提出利用“确定性等值”将内部风险价值V1具体化,从而实现对“近似孪生证券”方法进行修正。 相似文献
19.
In hardware design, it is necessary to simulate the anticipated behavior of the integrated circuit before it is actually cast in silicon. As simulation procedures are long due to the great number of tests to be performed, optimization of the simulation code is of prime importance. This paper describes two mathematical models for the minimization of the memory access times for a cycle-based simulator.An integrated circuit being viewed as a directed acyclic graph, the problem consists in building a graph order on the vertices, compatible with the relation order induced by the graph, in order to minimize a cost function that represents the memory access time. For both proposed cost functions, we show that the corresponding problems are NP-complete. However, we show that the special cases where the graphs are in-trees or out-trees can be solved in polynomial time. 相似文献
20.