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931.
亚像元边缘检测系统的FPGA实现 总被引:1,自引:0,他引:1
提出了一种集成于单片FPGA的数字化线阵CCD边缘检测系统。通过对CCD输出图像的边缘灰度梯度分析,利用高斯滤波除噪、边缘检测算法确定其像元级边界,并提出了一种以最小二乘多项式拟合来确定亚像元级边界位置的新算法。整个系统以现场可编程门阵列器件作为核心及数字电路硬件的载体,利用VHDL语言及图形化输入方式在QuartusⅡ7.2软件平台上进行了系统的设计。误差分析及仿真结果表明,该边缘检测系统的分辨率可达到将近六十分之一的像元宽度,可应用于研制高精度CCD光电自准直仪。 相似文献
932.
用线阵CCD代替可移动的光电二极管,改进了声光调制实验。将声光调制的入射光和衍射光投射在线阵CCD上,线阵CCD的信号输出由数字示波器显示,利用数字示波器的"光标"功能测出光斑的距离。改进后,使测量变得简单快捷,提高了实验效率,并减小了实验测量误差。 相似文献
933.
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A very high frame rate camera is designed based on an innovative CCD driving method. The CCD driving method is mainly implemented on frame transfer CCDs. Asynchronous drive timing sequences are applied in the image and storage section of the CCDs. Several rows of the charge in the image section are binned onto the same row in the storage section, and there are the same number of images to be stored in the storage section before they are read out. Based on the new driving method, the frame transfer CCDs can work at a very high frame rate in acquiring burst images though the reading speed remains at a lower level. A very high frame rate camera is designed in this paper. The innovative CCD driving method is mainly of concern. An e2v's CCD60 is adopted in the camera system, whose full size resolution is 128 × 128, and the up most frame rate is 1000 Hz in the conventional CCD driving method. By using the presented method, the CCD60 based imager is capable of operating at up to 40000 frames per second (fps) at a recognizable resolution of 128 × 32. Comparing cameras using traditional binning and region of interest technologies, the frame rate is normally less than 5000 fps while the resolution is only 32 × 32 left. 相似文献
935.
936.
在分析e2v公司的CCD47—20 Backthinned NIMO型CCD器件驱动时序关系的基础上,结合空间面阵CCD相机电子系统的总体要求,完成了基于FPGA的驱动时序发生器与下位机的一体化设计。选用FPGA器件作为硬件设计载体,使用VHDL语言对一体化的时序与控制通信系统进行了硬件描述。针对ALTERA公司的FPGA器件EP1C6Q240C8对设计进行了RTL级仿真及配置,完成了一体化系统的硬件电路。硬件实验结果表明,所研制的基于FPGA的一体化的时序与控制通信系统不仅可以满足CCD芯片和视频处理的时序要求,还可以与CCD相机上位机进行可靠的串行通信,监测和控制相机的工作状态. 相似文献
937.
939.
940.