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101.
警务指挥模式已经历三个阶段:传统、信息、数据警务指挥,目前正在向智慧警务指挥转型发展.转型之际,南京公安提出点对点扁平化派警新机制,通过压缩派警层级、精准规范指挥、指令直达一线,最大限度提高反应速度,缩短出警时间,提升人民群众满意度.为了推动派警新机制落地,文中开展新一代智慧警务指挥调度体系设计,提出"1661"总体架构,即纵向横向统一指挥、六大支撑智能指挥、六大功能闭环指挥、"情报、指挥、勤务、舆情"(简称"情指勤舆")一体运行.基于该总体架构,汇聚内外部数据资源,贯通全局指挥体系,通联全市应急救援力量,实现向源头接警、扁平指挥、专业调度齐头并进的统一模式发展,全面提升应急救援处置和社会面防控效能. 相似文献
102.
103.
104.
105.
MAC-IP地址绑定的一种软件实现方法 总被引:4,自引:0,他引:4
通过深入研究ARP协议,以ARP欺骗方式实现了主机MAC和IP地址的绑定,并设计了一个可以跨越多个子网进行管理的MAC IP地址绑定软件解决方案。对解决方案的各组成部分的功能进行了介绍,提出了代理端和主控端的概念,并给出了具体的实现方法,并且从带宽和系统资源占用方面提出了优化方案,目前这种管理方案已经成功应用于工程实践中。 相似文献
106.
The necessity of establishing a Unified Isostatic Datum (UID) for studying the sea levelchanges along the coast of China is discussed in this paper. A so-called Coastal Land Ver-tical Movement Isostatic Datum (CLVMID) is established based on precise releveling dataperformed from the 1950s to 1980s and some coniunction releveling data with tide stations.All the data consists of about 250,000 km releveling lines and covers the whole mainland ofChina. As examples, datum corrections for sea level changes derived from two tide stationsand recent crustal vertical movement in the Yangtse Delta area relative to the datum aregiven to explain the significance of the isostatic datum in the research of the sea levelchange trend. 相似文献
107.
以模型费托合成Fe基催化剂为研究对象,在纯CO气氛中对催化剂进行不同时间的预处理,采用多种手段对预处理后催化剂的物理化学性质和抗磨损能力进行了表征。结果表明,在预处理初期,随着预处理时间的延长,催化剂的炭化程度显著提高,伴随着催化剂比表面积的降低和颗粒粒径的减小,而催化剂的抗磨损能力逐渐提高。当预处理时间超过72 h后,继续延长预处理时间,催化剂的炭化程度不再增加,而积炭程度逐渐增加,伴随着催化剂比表面积和颗粒粒径的增加,催化剂的质量也同时增加,并导致催化剂的抗磨损能力逐渐降低。 相似文献
108.
基于SMIC 65 nm CMOS工艺,设计了一种带曲率补偿的低压高电源抑制比(PSRR)带隙基准电压源。采用带曲率补偿的电流模结构,使输出基准电压源低于1.2 V且具有低温漂系数。在基本的带隙基准电路基础上,增加基准核的内电源产生电路,显著提高了电路的PSRR。采用Cadence Spectre软件,在1.8 V电压下对电路进行仿真。结果表明,在1 kHz以下时,PSRR为-95.76 dB,在10 kHz时,PSRR仍能达到88.51 dB,在-25 ℃~150 ℃温度范围内的温度系数为2.39×10-6 /℃。 相似文献
109.
设计了一种超高速高精度时钟占空比校准电路。采用一种新的脉冲宽度校准单元,通过控制电压调整时钟上升、下降时间来实现占空比调整。同时,设计了一种时钟放大模块,降低了占空比校准单元对输入时钟幅度的要求,提高了占空比校准精度。分析了各电路模块的作用以及对整体性能的影响。采用SMIC 65 nm CMOS工艺,在1.8 V电源电压下对各模块以及整体电路进行仿真验证。仿真结果表明,该时钟占空比校准电路能对输入频率为1~4 GHz、占空比为20%~80%的时钟进行精确校准,校准后的占空比为(50±1)%,系统稳定时间为200个输入时钟周期,功耗为10 mW。 相似文献
110.
设计了一种融合控制码(K码)与数据码(D码)、具有无效K码检测功能的高速8/10 bit编码器。深入研究了8/10 bit的编码特点以及K码与D码的内在相关性,提出了将K码融合于D码的改进编码方法。相比传统方法,该编码方法更简单,速度更快,占用逻辑资源更少。采用Verilog HDL语言设计了编码器,使用Modelsim软件对设计进行了功能验证,并利用Quartus II综合实现了8/10 bit编码电路。该编码器可直接应用于需要8/10 bit编码的收发器。 相似文献