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Hsu S. Alvandpour A. Mathew S. Shih-Lien Lu Krishnamurthy R.K. Borkar S. 《Solid-State Circuits, IEEE Journal of》2003,38(5):755-761
This paper describes a 32-KB two-read, one-write ported L0 cache for 4.5-GHz operation in 1.2-V 130-nm dual-V/sub TH/ CMOS technology. The local bitline uses a leakage-tolerant self reverse-bias (SRB) scheme with nMOS source-follower pullup access transistors, while preserving robust full-swing operation. Gate-source underdrive of -220 mV on the bitline read-select transistors is established without external bias voltages or gate-oxide overstress. Device-level measurements in the 130-nm technology show 72/spl times/ bitline active leakage reduction, enabling low-V/sub TH/ usage, 40% bitline keeper downsizing, and 16 bitcells/bitline. 11% faster read delay and 2/spl times/ higher dc noise robustness are achieved compared with high-performance dual-V/sub TH/ bitline scheme. Sustained performance and robustness benefits of the SRB technique against conventional dynamic bitline with scaling to 100- and 70-nm technology is also presented. 相似文献
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A jet-printed digital-lithographic method, in place of conventional photolithography, was used to fabricate 64 /spl times/ 64 pixel (300 /spl mu/m pitch) matrix addressing thin-film transistor (TFT) arrays. The average hydrogenated amorphous silicon TFT device within an array had a threshold voltage of /spl sim/3.5 V, carrier mobility of 0.7 cm/sup 2//V/spl middot/s, subthreshold slope of 0.76 V/decade, and an on/off ratio of 10/sup 8/. 相似文献
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4G mobile communications: toward open wireless architecture 总被引:2,自引:0,他引:2
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本文利用OMA-Ⅲ系统测量了脉冲TEA CO_2激光诱发的SiH_4等离子体发光谱内H巴耳末系的H_α、H_β和H_γ线的线型及线宽。通过理论及实验分析,认为这些谱线的主要加宽机制为Stark加宽。由实验线型和理论线型的拟合得到等离子体的电子温度T≈40000K和电子密度N≈10~(17)cm~(-3)。 相似文献