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静态时序分析是目前通用的芯片时序验证的重要方法,其依赖于时序模型和时序约束。时序约束是检验设计电路时序的准则,好的时序约束可以正确地体现芯片的设计需求。针对RapidIO交换芯片中存在的多时钟域构成、高速通道的高速时钟频率要求,2x/4x绑定模式下多lane时钟同步等的特殊要求,以及较多的跨异步时钟处理存在的问题,文中提出一种多分组的全芯片时序约束,通过设置时钟定义、时钟组定义、端口延迟定义、时序例外和虚假路径等,以及修正和优化必要的setup time/hold time违例,解决RapidIO交换芯片静态时序分析中的时序违例等时序问题,实现时序收敛的目的。实验验证及流片测试结果表明,所有时序路径均满足时序要求,RapidIO芯片的时序约束设计正确、完备。 相似文献
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近几年我区已普及了全固态发射机。该种机器效率高、工作稳定可靠,但全固态发射机对工作环境要求苛刻,主要是天线调配网络的阻抗匹配,它将直接影响发射机的安全运行,影响发射机输出的高频功率能否最大无失真的输送到天线上。通常对全固态发射机的输出网络有以下三点要求: 相似文献
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