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讨论了一个由IETF(Internet Engineering Task Force, 互连网工程任务组)所建议的、在目前的IPv4架构之下实现计算机移动通信的路由选择协议--移动IP(Mobile IP) ,分析了利用它实现计算机无缝漫游的原理,并探讨了移动IP和未来新一代互联网协议IPv6的结合问题. 相似文献
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SOC设计过程的质量保证 总被引:1,自引:0,他引:1
SOC的出现,导致IC业的进一步分工,出现了系统设计、IC设计、第三方IP、电子设计自动化(EDA)和加工等各种专业.同时,它们又紧密结合,为用户提供完整统一的解决方案,这就促使各专业慢慢形成虚拟的再集成,构成一种"虚拟"的整体.在这种包含复杂而密切联系的分工的"虚拟"实体中,如何保证最后SOC产品的质量,是一个非常困难的问题.本文讨论了分别基于模块和平台的SOC不同功能的验证方法,提供解决SOC产品的质量. 相似文献
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SOC设计过程的质量保证 总被引:1,自引:0,他引:1
SOC的出现,导致IC业的进一步分工,出现了系统设计、IC设计、第三方IP、电子设计自动化(EDA)和加工等各种专业。同时,它们又紧密结合,为用户提供完整统一的解决方案,这就促使各专业慢慢形成虚拟的再集成,构成一种“虚拟”的整体。在这种包含复杂而密切联系的分工的“虚拟”实体中,如何保证最后SOC产品的质量,是一个非常困难的问题。本文讨论了分别基于模块和平台的SOC不同功能的验证方法,提供解决SOC产品的质量。 相似文献
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一种基于嵌入式IP内核模块的测试方法 总被引:1,自引:0,他引:1
嵌入式内核结构的测试正面临着新的挑战,需要提出有效的测试方法。针对IP内核模块测试所面临的技术难点,详细介绍了IP核模块实现测试所需要构建的硬件环境和完整的测试方法,并分析了由测试理论和方法而形成的国际公认标准IEEEP1500。 相似文献
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设计了一种专用PLC微处理器SOC模块FSPLC,基于IP核复用方法和SOC技术复用第三方AVRAT90S1200IP核基础上集成了自行设计的LP、BP、MBI、CBI、BBI等模块,以AlteraNiosII开发板作为验证平台对实际的PLC应用程序做了可行性验证,FSPLC具有快速处理PLC梯形图程序、快速处理指令表语句中复杂的嵌套逻辑运算、PLC之间CAN总线通讯等优点。 相似文献
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分析目前几大IP质量评测标准特点,指出当前用于转让和交互的IP评测标准,着重于共同特征,缺乏个性特征,特别是针对功能特征的描述。基于功能分类,提出面向IP设计流程和IP功能目录的第三方质量评测方法。将IP功能特征引入质量空间,新的IP质量评测标准更客观、可行。作为方法示例,介绍运算处理类软IP核的质量评测过程。 相似文献
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Pete Hardee 《电子产品世界》2003,(16):55-56
各电子公司正在转向生产采用数字融合技术的产品,这就要求设计者在6~9个月的设计周期内即能提供功能空前复杂的集成电路和片上系统(SystemsonChip,SoC),而且以大批量销售价格供货。这些芯片已经应用于流行的、面向消费者的手持式计算、多媒体和互联网驱动通信产品。SoC设计的复杂性基于SoC概念的设计复杂性,给项目小组带来了巨大的挑战,因为在一个典型系统中将包含众多的功能模块。对于目标系统这样复杂的项目来说,如果要从头设计,即使是人数最多、最有经验而且最为能干的项目团队也是难以胜任的。某种形式的电路知识产权(IP)复用机制已… 相似文献
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文章介绍了一个面向SOC设计的可变规模的LeD驱动IP核,该IP包括四个独立的LeD驱动单元(DU)。不仅可以通过配置该IP使四个独立的Du分别驱动不同规模的LCD,而且能够实现四个Du级联来面对更复杂的应用场合。此外,设计了一个与wishbone总线相兼容的接口模块wrapper,并将该IP结合wrapper模块嵌入到0R1200平台来进行系统级的仿真验证。仿真结果表明该IP达到了设计要求,且通过修改wrapper模块可使该IP核适用于不同的SOC设计平台。 相似文献
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梁志恒 《信息安全与通信保密》2005,(7):29-31
前言最近几年安全建设发展得如火如荼,但许多用户,尤其是大中型企业用户发现,防病毒、防火墙、VPN、入侵检测、扫描器等大量安全产品的购买和部署,似乎并没有达到企业安全防护能力大幅度提升的目的。大量的安全警告、误报、漏报、简单而意义表达不清晰的告警等,常常困扰用户;众多安全厂商和产品之间采用独立的控制台进行管理,安全管理员奔波于不同的控制台之间,仍得不到充分和准确的安全信息。 相似文献
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基于IP的系统芯片(SOC)设计 总被引:1,自引:0,他引:1
随着集成电路设计与工艺技术水平的提高,出现了系统芯片(SOC)的概念。本文介绍了基于IP的SOC设计方式的设计流程,指出了其与传统IC设计方法的不同。讨论了支持SOC设计的几种关键技术,并对SOC的技术优势及发展趋势作了全面阐述。 相似文献
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SOC用400-800MHz锁相环IP的设计 总被引:4,自引:0,他引:4
设计了一个基于锁相环结构、可应用于SOC设计的时钟产生模块.电路输出频率在400~800 MHz,使用SMIC 0.18 μm CMOS工艺进行流片.芯片核心模块工作电压为1.8 V和3.3 V.根据Hajimi关于VCO中抖动(jitter)的论述,为了降低输出抖动,采用一种全差动、满振幅结构的振荡器;同时,通过选取合适的偏置电流,实现对环路带宽的温度补偿.流片后测试结果为:输出频率范围400~800 MHz,输入频率40~200 MHz;在输出频率为800 MHz时,功耗小于23 mA,周期抖动峰峰值为62.5 ps,均方根(rms)值为13.1 ps,芯片面积0.6 mm2. 相似文献
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