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BCH码是一种理论上比较成熟的代数码型,在电力通信系统,GSM标准的语音和数据业务,以及卫星通信和数字广播通信(DVB-S2)等多个领域均有着广泛的应用。基于幂次运算,在线性反馈移位寄存器(LFSR)下实现了基于Berlekamp-Massey(BM)时域迭代译码算法的整个译码器构架,以及BM简化算法的硬件设计。通过计算机模拟仿真表明,两种算法的译码速率分别可达到32Mbps,37Mbps。 相似文献
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DTMF信号因具有较强的抗干扰能力,目前被广泛应用于电话拨号及交互式控制系统中,对它的检测十分关键。该文根据Goertzel算法原理,采用IIR带通滤波器组的方式对其进行检测,给出了相应的检测步骤,方法,参数设计及仿真结果。 相似文献
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在分析空频分组码(SFBC)编译码算法的基础上,重点研究了译码算法的工程实现方法。为解决SFBC码译码器现场可编程门阵列(FPGA)实现时的复杂性高、占用资源多的问题,提出了一种基于FPGA的优化译码器结构和实现方案,有效减少了资源占有量,提高了处理速度,并在Xilinx的xc4vlx80芯片上实现了SFBC码译码器,通过时序仿真结果验证了译码结构的有效性和实用性。 相似文献
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HDB3编译码电路的FPGA设计 总被引:1,自引:0,他引:1
HDB3码(3阶高密度双极性码)保持AMI码极性反转的特点,减少连0串的长度,有利于提取定时信息,广泛用于数字通信系统中。针对现有HDB3编码器中存在编码复杂、输出延时长等缺点,设计一种统一位置判断和极性判断的HDB3编码器,并从实际应用出发,将误码检测和位同步提取融入译码器芯片中。仿真和实测表明,编译码功能正确,且相对延时较小、灵活性高,具有实用价值。 相似文献
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根据系统高速、稳定的要求,采用FPGA技术实现了针对(2,1,7)卷积编码的软判决Viterbi译码器.考虑到芯片的速度、面积和功耗,通过对Viterbi译码和前端接口部分设计的若干优化算法进行研究和讨论,选择4bit量化、差分软译码、大回朔深度和最小状态判决准则等方案以保证性能.采用全并行ACS结构和寄存器交换法以提高速度,并且采用分支度量预计算、度量存储溢出控制及对译码器其他部分的优化设计,在保证时序稳定的情况下有效减少了硬件消耗. 相似文献
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低密度奇偶校验码(Low-Density Pariy-Check codes,LDPC codes)是一种基于图和迭代译码的信道编码方案,它是据Turbo码的另外一种性能非常接近Shannon极限的信道编码.本文在探讨了LDPC码的经典BP(Belief ProPagation)译码算法的基础上,采用一种改进行的复杂度... 相似文献
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基于FPGA的高速Viterbi译码器设计与实现 总被引:1,自引:0,他引:1
Viterbi算法是卷积码最常用的译码算法,在卷积码约束长度较大,译码时延要求较高的场合,如何实现低硬件复杂度的Viterbi译码器成为新的课题。本文提出新颖的Viterbi路径权重算法、双蝶形译码单元结构、高效的状态度量存储器等技术,使Viterbi算法充分和FPGA灵活原片内存储和逻辑单元配置方法相结合,发挥出最佳效率。用本算法在32MHz时钟下实现的256状态的Viterbi译码器译码速率可达400Kbps以上,且仅占用很小的硬件资源,可以方便地和Furbo译码单元等集成在单片FPGA,形成单片信道译码单元。 相似文献
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DTMF因具有很强的抗干扰能力以及较快的传输速度,被广泛应用于音频电话系统以及交互式控制系统中,如语音邮件、电话银行以及ATM终端等。因此对它进行正确的检测十分关键。这里就DTMF信号检测中的Goertzel算法原理以及主要参数的选择进行详细分析,重点对参数N的选取进行论证。给出DTMF信号的检测流程及仿真结果。最后将它与传统的FFT算法相对比从而得出Goertzel算法的优势。 相似文献
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对讲机通信中,一般使用亚音频信号(CTCSS)作为识别信号,判断是否对接收到的信号进行解码。提出了Goertzel算法在对讲机的亚音频提取的应用。Goertzel是一种特殊的离散傅里叶变换的方法,对于检测单频率有很好的效果。大幅度降低了亚音频提取的计算量,通过降低算法开销来降低整个系统的成本。相对于传统的使用独立IC识别或者傅里叶变换法,本方法有很大的优势,在生产中得到良好的应用。 相似文献
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音乐信号音阶频率分析的基本方法是快速傅里叶变换,但其谱线频率与定义的音阶频率在位置上有误差。对此,常数Q变换可以提供更好的性能,但其效率并不令人十分满意。本文基于Goertzel算法,给出一种音阶频率分析的方法。它具有简单有效、且容易编程的特点。 相似文献
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LDPC码在深空通信中有很好的实用价值,同时LDPC码也被广泛应用于光纤通信、卫星数字视频和音频广播等领域。针对LDPC译码器提出一种新的设计思路,将流水线思想从译码算法本身扩展到译码器的整体设计中,设计出可以多帧并行且结构简单的译码器,最后从吞吐量和资源消耗两方面进行仿真验证。 相似文献