超短波低噪声放大器的设计

采用0.5μm GaAs增强型赝配高电子迁移率晶体管(E-PHEMT)工艺技术设计了一款10～1000 MHz具有低噪声和高线性度的超短波低噪声放大器.该放大器利用有源偏置电路和共源共栅结构设计而成,提出的新型有源偏置电路使该低噪声放大器(LNA)能够在复杂的环境中稳定地工作.仿真结果表明,在工作频带内,增益高于22 ...     

一种线性化低噪声放大器的设计

通过在共源共栅电路中加入线性辅助电路,利用线性化补偿技术设计了一个位于雷达接收机前端的高线性低噪声放大器,在保持其他指标基本不变的情况下,线性度提高约17.5dB;该电路采用CMOS 0.18μm工艺设计,电源电压1.8V,信号频率在2.9～3.6GHz,仿真结果是:增益大于10dB,噪声系数(NF)低于1.35dB,三阶输入截点功率(IIP3)为17.48dBm,消耗直流电流13.24mA.     

高线性低电压低噪声放大器的设计

研究了一种具有高线性的CMOS低噪声放大器,其工作电压可以低于1V.在这个电路中,加一个工作在线性区的辅助MOS管以提高线性特性.仿真表明这种方法可以提高输入三阶交截点,其代价远小于传统方法为获得1dB线性度改善而必须增加1dB功耗的代价.为了降低该电路中的共栅PMOS管的有载输入阻抗,不使其源极处的电压增益过大而降低电路的线性特性,必须优化其尺寸.仿真使用的模型是TSMC 0.18μm射频CMOS工艺库,仿真工具是Cadence的SpectreRF.     

高线性低电压低噪声放大器的设计

研究了一种具有高线性的CMOS低噪声放大器,其工作电压可以低于1V.在这个电路中,加一个工作在线性区的辅助MOS管以提高线性特性.仿真表明这种方法可以提高输入三阶交截点,其代价远小于传统方法为获得1dB线性度改善而必须增加1dB功耗的代价.为了降低该电路中的共栅PMOS管的有载输入阻抗,不使其源极处的电压增益过大而降低电路的线性特性,必须优化其尺寸.仿真使用的模型是TSMC0.18μm射频CMOS工艺库,仿真工具是Cadence的SpectreRF     

高线性低噪声放大器设计

介绍一种L波段单级高线性低噪声放大器的工作原理和设计方法。与传统的接收机射频前端放大器主要考虑低噪声和高增益特性不同，文中选用了低成本、低功耗的SiGe NPN BJT器件设计高三阶交截点的低噪声放大器。设计中利用了微波CAD工具对电路进行仿真与优化，同时对生成的微带印刷电路板进行了电磁仿真。     

一种应用于GPS接收机的高线性度SiGe HBT低噪声放大器

A high linearity 1.575 GHz SiGe：HBT low noise amplifier （LNA） for global positioning system applications is described. The bipolar cascoded with an MOSFET LNA was fabricated in a commercial 0.18 μm SiGe BiCMOS process, A resistor bias feed circuit with a feedback resistor was designed for the LNA input transistor to improve its intermodulation and compression performance. The packaged chip tested on board has displayed a noise figure of 1. I 1 dB, a power gain of 18 dB, an output 1 dB compression point of ＋7.8 dBm and an input third-order intercept point of ＋1.8 dBm. The chip occupies a 500 × 560μm^2 area and consumes 3.6 mA from a 2.85 V power supply.     

应用于S波段的高线性低噪声放大器

采用E-mode 0.25um GaAs pHEMT工艺,2.0mm × 2.0mm 8-pin双侧引脚扁平封装,设计了一款应用于S波段的噪声系数低于0.5dB的低噪声放大器。通过采用共源共栅结构、有源偏置网络和多重反馈网络等技术改进了电路结构,该放大器具有低噪声,高增益,高线性等特点,是手持终端应用上理想的一款低噪声放大器。测试结果表明在2.3-2.7GHz内,增益大于18dB,输入回波损耗小于-10dB,输出回波损耗小于-16dB,输出三阶交调点大于36dB。     

用于相控阵雷达的高线性度低噪声放大器

基于IBM 0.18 μm SiGe BiCMOS工艺,提出了一种用于Ku波段相控阵雷达的高线性度低噪声放大器。该放大器采用2级级联结构,第1级优化可获得最小的噪声性能,第2级优化可提高电路的增益和线性输出功率。为了提高线性度,第2级采用了具有线性补偿功能的线性化偏置电路。仿真结果表明,在中心频率为16.5 GHz,带宽为2 GHz的频带范围内,噪声系数小于3.9 dB,其最小值为3.22 dB,功率增益大于23.5 dB,输出1-dB压缩点在中心频率处大于6.5 dBm。在3.3 V电源电压下,静态功耗为66 mW,芯片面积为(1 245×580) μm²。     

一种采用后失真技术的高线性巴伦低噪声放大器

宽带低噪声放大器能同时接收多路信号,这些信号会相互成为干扰源,因此要求宽带低噪声放大器同时具有较高的IIP2和IIP3,抑制这些干扰。在传统共栅共源巴伦低噪声放大器的基础上,对决定噪声和线性度的共源级采用了后失真技术。通过一个PMOS辅助管,对共源级输出信号的二次和三次非线性项都进行了抑制,使得整个放大器的线性度得到较大的提升。在0.2~4.35 GHz的范围内,该放大器的IIP2大于23 dBm,IIP3大于5 dBm。另外,共源放大管的衬底电阻对放大器有较大的噪声贡献,通过串接一个衬底大电阻,将其噪声贡献由10%降低到了1%左右。     

VHF-UHF超低噪声放大器的设计

介绍了应用Avago ATF-54143设计VHF-UHF超低噪声放大器,阐述了利用电感串联反馈、RC反馈技术,损耗一定的增益,实现输入输出匹配和放大器的无条件稳定.利用ADS进行仿真设计,对产品实际测量,G>20 dB,NF<1 dB,0IP3>35 dBm.结果表明此低噪声放大器达到了预设的技术指标,性能良好,可用于接收机前端.     

1.9 GHz CMOS低噪声放大器的结构分析与设计

对低噪声放大器(LNA)的结构及性能进行了详细的分析。采用SMIC 0.18μm射频CMOS工艺,设计了用于GSM1900无线接收机系统的两种不同结构的差动式LNA(电流复用式PMOS-NMOS LNA)和典型的NMOS LNA。利用Cadence-SpectreRFTM,对这两种结构的LNA进行了电路级仿真和对比分析。结果表明,在功耗相近时,PMOS-NMOS LNA能够提供比较大的电压增益,其噪声特性与NMOS LNA相近;NMOS LNA在线性度以及芯片面积上有更多的优势。     

一种宽带低噪声视频放大器的设计

介绍了一种宽带低噪声视频放大器的设计,并给出了实验结果。该视频放大器在自制IC的基础上,采用MCM工艺混合集成。经测试,该电路电压增益大于70 dB,带宽45 MHz,AGC范围大于65 dB,噪声系数小于1.5 dB。     

一种低噪声高线性度CMOS上变频混频器

设计实现了一种采用开关跨导型结构的低噪声高线性度上变频混频器,详细分析了电路的噪声特性和线性度等性能参数,本振频率为900 MHz。芯片采用0.18μm Mixed signal CMOS工艺实现。测试结果表明,混频器的转换增益约为8 dB,单边带噪声系数约为11 dB,输入参考三阶交调点(IIP3)约为10.5 dBm。芯片工作在1.8 V电源电压下,消耗的电流为10 mA,芯片总面积为0.63 mm×0.78 mm。     

5.8GHz低噪声放大器的设计与优化

设计了一种低压、低功耗、输出阻抗匹配稳定的CMOS差分低噪声放大器.基于源极电感负反馈共源共栅结构,提出了基于MOS管中等反型区最小化Vdd·Id的方法,以优化功耗.在共栅晶体管处并联正反馈电容,以提升电路增益.对电路的噪声系数、输出阻抗稳定性、芯片面积等也进行了优化.仿真结果表明,当电源电压为1V,工作频率为5.8 GHz时,设计的低噪声放大器的噪声系数为1.53 dB,输入回波损耗为-22.4 dB,输出回波损耗为-24.6 dB,功率增益为19.2dB,直流功耗为4.6 mW.     

X波段低噪声放大器设计

针对目前X波段低噪声放大器的电路拓扑结构不易选择,故提出了一种采用微带分支线匹配结构和三级级联方式的X波段低噪声放大器(LNA)。放大器选用NEC低噪声放大管NE3210S01,利用ADS(Advanced Design System)软件设计、仿真、优化,放大器实测结果表明:在9.2 GHz～9.6 GHz频带内,噪声系数小于1.7 dB,带内增益达到33.5 dB,带内增益平坦度ΔG≤±0.3 dB,输入、输出驻波比均小于1.5。该放大器已应用于X波段接收机,效果良好,其设计方法可供工程应用参考。     

一种低闪烁噪声高线性度WLAN混频器的设计

提出一种适用于零中频接收的WLAN混频器,采用折叠结构降低开关对的偏置电流,以得到良好的闪烁噪声性能;通过在混频器的驱动级引入辅助管,并优化其衬底电压和尺寸来抵消跨导管的非线性,进而提升电路的线性度.利用Volterra级数辅助分析制约线性度特性的限制因素.基于Chartered O.18 μm CMOS工艺的Spectre-RF仿真表明,电路在WLAN的2.4 GHz频段具有良好的电学性能,噪声系数为8.6 dB,闪烁噪声角为105 kHz,IIP3为5.8 dBm,芯片整体功耗为10 mW,核心电路占用面积为0.09 mm2.     

一种新型2.4 GHz RF低噪声放大器的设计

提出了一种新型的低噪声放大器,在输入管的栅极加入一个电容,使放大器的噪声性能与增益都得到明显的改善。该电路基于Chartered 0.18μm CMOS工艺设计,工作频率为2.4GHz。仿真表明,在电流消耗为300μA的条件下,提出的低噪声放大器具有更好的噪声系数与增益,分别比传统的电感源极衰减低噪声放大器改善1.9 dB与5.3 dB。     

高性能低噪声放大器的设计

低噪声放大器（LNA,Low Noise Amplifier）能有效放大射频小信号,降低系统的总体噪声,提高接收机的灵敏度。该文介绍了低噪声放大器的主要性能指标和设计方法,该电路选用ATF-54143晶体管,采用两级放大,利用Agilent ADS软件完成一个S波段低噪声放大器的偏置电路以及输入、级间和输m匹配的设计和仿真。本设计中,在源极加入短路微带线形成反馈作用,从而提高稳定性。最后对仿真完的电路进行了加丁测试。经测试,在2.15-2.65GHz的频带内,获得了27-2-28.1dB的增益,增益平坦度小于±0.9dB,噪声系数小于ldB,输入电压驻波比为l.048-1.640,输出电压驻波比为1.120-1.840,在中心频率点2．4GHz上．输出功率ldB压缩点为162dBm。     

一种低功耗双频段低噪声放大器

基于TSMC 0.18 μm CMOS工艺,设计并实现了一种双频段低噪声放大器(DB-LNA)。在输入级中,采用了2个LC并联谐振网络串联结构,结合PMOS管的源极负反馈电感,实现了DB-LNA在双频段的输入阻抗匹配。在放大级中,采用CMOS互补共源放大结构和电流复用技术,在提高系统增益的同时,实现了DB-LNA的低功耗。在输出级中,采用NMOS晶体管作电流源的源跟随器,对信号电压进行缓冲,实现了输出阻抗匹配。利用ADS进行仿真验证,结果表明,该低噪声放大器在1.9 GHz和2.4 GHz 2个工作频段下,其增益(S₂₁)分别为26.69 dB和20.12 dB;输入回波损耗(S₁₁)分别为-15.45 dB和-15.38 dB;输出回波损耗(S₂₂)分别为-16.73 dB和-20.63 dB;噪声系数(NF)分别为2.02 dB和1.77 dB;在3.5 V的工作电压下,静态功耗仅有9.24 mW。     

超宽带CMOS低噪声放大器的设计

设计了一种应用于3.1~5.2 GHz频段超宽带系统接收机的差分低噪声放大器,采用前置切比雪夫(Chebyshev)2阶LC ladder带通滤波器的并联负反馈结构,详细分析了其输入宽带阻抗匹配特性和噪声特性。仿真基于TSMC 0.18μm RF CMOS工艺。结果表明,在全频段,电路功率增益S21为11 dB,增益平坦度小于1 dB,最小噪声系数为3.5 dB,输入输出均良好匹配,在1.8V电源电压下,功耗为14.4 mW。