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本文在介绍压控晶振主要技术指标的基础上阐述了5MHz精密压控晶振的组成及晶振电路、恒温控制电路的工作原理,介绍了提高其性能的措施,最后给出了实测结果。 相似文献
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用DDS实现测试晶体频率的系统 总被引:2,自引:0,他引:2
介绍了用PC机和单片机控制DDS频率输出实现测试晶振频率的系统的硬件结构和软件设计,讨论并分析了采用AD9854实现该系统的方法并给出了实验结果。 相似文献
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接收机的相位噪声实际上专指频率合成器的相位噪声,而频率合成器的相位噪声是衡量其短期稳定度的一个技术指标,目前国内外的频率合成器基本采用锁相环(PLL)或多个锁相环的方式.频率合成器的频率稳定度包括长期稳定度和短期稳定度.长期稳定度一般由基准频率源(通常为恒温晶振或温度补偿晶振,或由外部基准频率源)决定,短期频率稳定度由锁相环决定(环路参数、部件如压控振荡器).相位噪声早期也称为相位抖动,在时域多用阿仑方差表示,在频域多用相位噪声(偏离载波某个频偏处的单位带宽内相位噪声功率相对主载波的功率低多少,通常用dBc/Hz表示,dBc中的c表示相对值)表示. 相似文献
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介绍一种宽范围、高稳晶振的频率稳定度测试系统设计,整个设计以铷原子钟为标准钟,采用直接数字频率合成技术,使用高分辨力频率计数器进行测量、计算,并由AVR单片机和CPLD可编程器件完成控制.实验结果证明,该设计不仅具备传统频稳测试系统的功能,而且又为解决非标准、高稳晶振的频率稳定度测试提供具体的方法. 相似文献
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GPS接收机中晶振误差的模拟方法 总被引:8,自引:0,他引:8
GPS(Global Positioning System)接收机中参考频率源的性能对接收机整体性能有着诸多影响。该文对在GPS接收机中使用最多的晶振的误差特性和性能影响进行了分析,在此基础上提出了一种模拟晶振频率误差的方法,即首先确定晶振在给定取样时间间隔上各主要随机误差成分的Allan(阿仑)方差参数,由此反演产生相应的各项晶振频率误差模拟序列并进行叠加。文中给出了计算机数值模拟的方法,并对仿真实验结果进行了分析,从而为GPS接收机设计、性能评估和测试平台如GPS信号模拟器的研制提供有关的理论支持和设计方法。 相似文献
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利用精密单点定位技术评估晶振频率稳定度 总被引:1,自引:0,他引:1
在评估晶振频率稳定度时,目前常用一个频率稳定度比待测晶振高3倍以上的时钟作为参考,造成测试成本高昂。在分析精密单点定位(Precise Point Positioning,PPP)技术原理的基础上,提出了一种基于PPP技术的频率稳定度评估方法,并利用该方法对一款秒稳达到10-12的高稳定度恒温晶振(Oven Controlled Crystal Oscillator,OCXO)进行了评估,评估结果与利用氢原子钟为参考的传统频率稳定度评估方法基本吻合。最后给出了该方法对不同等级晶振的评估能力。该方法结构简单,测试方便且成本低廉,能满足常用时频设备(如通信设备、卫星导航接收机)的晶振评估需求。 相似文献
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《现代电子技术》2014,(9):148-153
设计了一种高性能Pierce晶体振荡器及频率校准电路。采用耗尽型NMOS管实现低功耗的1.5 V基准电压,晶体振荡电路采用基准电压供电,降低了振荡器的功耗同时提高输出频率的精度。为了进一步提高输出频率的精度,芯片内部集成熔丝修调电路,通过校正晶振负载电容,实现芯片封装后振荡电路输出频率的校准,校准范围为(-52.216 ppm,54.962 ppm),校准最大步长为3.723 ppm。增加数字方式校准电路,在具有温度检测功能的系统中,可以扩展实现计时的温度补偿功能,提高芯片的计时精度,校准范围为(-189.100 ppm,189.100 ppm),校准步长为3.050 ppm。电路在0.5μm-5 V CMOS工艺上实现。整个时钟芯片版图面积为0.842 mm×0.996 mm。 相似文献
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市场研究机构Databeans的调查表明,2007年全球时钟市场收入为16亿美元,预计2007年-2012年总时钟市场年复合增长率(CAGR)将达到11%.随着市场应用走向融合,硅基时钟和晶振供应商将进行整合,硅基锁相环(PLL)时钟解决方案将继续替代传统晶振(XO)以满足更高频率,复杂度及系统同步对时钟解决方案的要求. 相似文献