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针对传统FPGA模式开发的锁相环在实时人机交互方面的不足,设计了基于LabVIEW FPGA技术的三相锁相环;方案以sbRIO-9631模块为硬件平台,利用LabVIEW编程控制FPGA逻辑,在FPGA中分三级流水线实现了基于dq变换的锁相环算法,并通过FIFO实时上传采集信号、锁定相位至PC机,最后在PC机上实现对锁相环性能分析、PI参数调控和数据显示;经过实验,该锁相环具有较高的精度,锁相时间约为两个周期,锁相误差约为0.03 rad,通过PC机可实时调节锁相性能。 相似文献
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冯雷 《工程物理研究院科技年报》2003,(1):304-306
锁相环路(PLL)是一个能够跟踪输入信号相位的闭环自动控制系统,具有载波跟踪特性,可以提取淹没在噪声中的信号。锁相环可分为全数字锁相和取样锁相环。其中取样锁相环为数模混合锁相环路,又可分为分谐波采样锁相环和分频式锁相环。分频式锁相环具有较高的稳定度、较低的相位噪声和易于集成等优点,而分谐波采样锁相环还可以提供更低的相位噪声,它们在通信技术中都有着广泛的应用。 相似文献
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基于量子理论获取相位参数的导航机制,理论上可以突破经典物理极限对导航精度的限制.利用量子零拍探测对相干态光场相位进行测量时,通常需要相位与之正交的本振光才能使测量精度达到量子标准极限.由于导航信号相位的高非线性特点,想要利用传统的线性锁相环获取完全满足条件的本振光具有一定的难度.为此,本文设计了一种基于容积准则的非线性锁相环,实现了在非正交本振光的条件下对相干态相位进行精确测量的功能.首先,利用相干态的Wigner函数推导了其相位在量子零拍探测的输出结果,设计了量子相位估计的非线性数字锁相环框架.然后基于正交单纯形容积准则设计了非线性滤波算法实现锁相环功能,该锁相环通过对本振相位进行多次状态更新,最终实现非线性迭代估计.实验结果表明,本文方法突破了本振光相位需与相干态相位正交的局限性,避免了传统量子锁相环方法引入的线性化误差,实现了对相干态相位的准确、稳定估计. 相似文献
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针对在基波频率变化情况下传统锁相环无法进行正确锁相的问题,提出了基于同步参考坐标系的追踪型三相软件锁相环.三相电压信号(Va、Vb、Vc)经同步坐标变换后,得到两相静止坐标(Vα、Vβ)信号,再经过旋转坐标变化后获得(Vd、Vq)信号;Vq信号经过低通滤波后,进行动态信号延迟,其延迟的时间由输出的频率信号获得;把延迟前... 相似文献
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Minghua Chen Minyu Yao Caiyun Lou Yizhi Gao 《International Journal of Infrared and Millimeter Waves》1998,19(12):1721-1734
In this paper, the properties of the optical phase-locked loop(PLL) based on the four-wave mixing in the semiconductor laser amplifiers (SLAs) are discussed. The components that achieve the function of detecting the bit phase of the input optical signal are concerned and discussed in detail together as a function module named as the optical bit phase detector referred to the general electronic PLL. Therefore, most of the properties of the optical PLL can be analyzed by applying the general phase-locked theory. Here the stability of the optical PLL is discussed. It's shown that the variance of input signal power in the practical application will cause optical PLL system unstable because of its long loop delay. The influence on the output phase jitter of the optical PLL is also investigated. 相似文献
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波的核心是相位,驻波的关键是入射波与反射波的相位差,入射波和反射波相位随x、t变化的关系可用相位图(移动的斜线)表示,而相位差仅随x变化,也可用斜线表示,这样即可很方便地确定波节和波腹的位置。 相似文献
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为实现数字BPM时钟系统的锁相,设计了一种基于锁相环同步原理的低抖动、低相位噪声的时钟同步系统。根据锁相环电路工作原理,对数字BPM时钟同步系统的硬件及固件程序进行了设计,实现了外部输入时钟信号与系统内部产生的主工作时钟信号的锁相,并且时钟信号输出的频率及相位均可调整以满足后端ADC采样的要求。测试结果表明,设计可以完成对一定频率范围内变化的外部输入时钟信号的锁相,输出时钟信号抖动满足束流实验要求,为数字BPM后续算法研究提供了基础。 相似文献
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射频相位参考线是粒子加速器的重要组成部分之一,为射频低电平控制系统(LLRF)、束流诊断系统、定时系统等提供稳定的相位锁定参考信号。为减少远距离传输过程中由环境温度变化导致的射频传输线中的射频相位漂移,多个加速器装置中已经采用射频相位参考线提供射频相位参考,这些相位参考的实现方案主要是基于恒温控制和基于光纤锁相。与这些方案相比,采用相位平均方法不仅可以保持长距离节点之间的相位稳定,而且更易于现场安装与维护。现有的带有锁相环(PLL)的终端短路方式实现相位平均参考线的方案仍有一些节点数量限制等方面的不足,本文对相位平均参考线结构进行了去除PLL的简化设计并进行了验证,以期增加更多的相位分配节点以及降低对射频器件参数的要求。对非PLL的单端输入终端短路相位平均方案与两端输入各节点间互为参考的相位平均方案分别进行了实验测试,结果表明两者的相位RMS精度可以达到0.1°~0.3°。并对不同的相位平均实现方案中相位不稳定的产生原因进行了分析,结果表明,除环境温度外,同轴线缆材质、合成相位与幅度的不平衡合成等也是重要影响因素。 相似文献