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量子元胞自动机(Quantum-dot Cellular Automata,QCA)是一种具有新型计算范式的纳米器件,它是未来有望替代传统CMOS器件的有力竞争者之一.本文首先从QCA器件的功耗角度出发,对影响半径为41nm的QCA共面系统中元胞的耦合度进行建模,根据元胞之间的位置关系构造QCA门结构模型,据此对现有的共面五输入择多门进行分类,通过性能分析总结其结构特点,以此设计出一个新的低功耗五输入择多门,测试结果表明该结构功耗最低且其他性能也相对较优.另外,为验证所提出五输入择多门在电路中的性能,本文选择MR Azghadi全加器设计了一款共面QCA全加器,与同类加法器相比性能也最优. 相似文献
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简述了量子元胞自动机 (QCA)的理论及其逻辑电路的实现方式。每个量子元胞包含两个电子 ,它们通过库仑相互作用与邻近元胞耦合。每个量子元胞上的电荷分布趋于沿两垂直轴的某一轴向分布 ,可以以此来表达二进制信息。用这些量子元胞的阵列来实现各种逻辑门 相似文献
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作为一种新型的纳米器件,量子元胞自动机(Quantum-dot cellular automata,QCA)有望取代传统CMOS器件.本文总结了目前已提出的三种全加器(Full Adder,FA)架构,通过概率转移矩阵(Probabilistic Transfer Matrix,PTM)分析找出其中最稳定的架构,进一步地,利用这三种全加器分别构建串行加法器,并从复杂度、不可逆功耗、成本等方面进行比较,结果发现性能最优的全加器架构为MR Azghadi FA.随后,选择该架构提出了一种针对全加器的新型逻辑门和共面QCA全加器电路,并应用此全加器设计了多位串行加法器,经对比分析表明,本文所提出的全加器电路在面积、元胞数和功耗等方面均有较大改进,且具有很好的扩展性. 相似文献
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择多逻辑门和反相器是量子元胞自动机(QCA)逻辑电路的基本组件。设计了两点量子元胞自动机(两点QCA)的传输线、择多逻辑门和反相器等基本逻辑器件。通过仅在信号沿竖直方向传递需要取反时用到水平放置元胞的设计,使电路布局更加紧凑。利用这些基本逻辑器件完成了一位数值比较器电路的设计。基于两点QCA系统的半经典模型,利用遗传模拟退火法对电路功能进行了仿真。仿真结果显示,两点QCA同样能够有效实现传统四点QCA的功能,而其所需的电子数和量子点数均减少了32.1%,电路集成度提高了49.4%。 相似文献
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余宸解光军邓凤斌张永强吕洪君 《微纳电子技术》2018,(1):6-12
由于互补金属氧化物半导体(CMOS)器件尺寸的限制,量子元胞自动机(QCA)成为有望替代CMOS的新兴纳米器件。量子元胞自动机具有超低功耗、超高速度和高密度结构的潜在优势。提出了一种新型的同或门结构,在面积、延迟、复杂度及功耗方面相较于之前的结构均存在优势。所提出的新型同或门结构仅使用28个面积为0.02μm^2的QCA元胞,延迟仅为0.75个时钟周期。为了检验提出的设计在大型复杂QCA电路中的性能,实现了4,8和16位的奇偶校验器电路。模拟结果表明,所设计的电路性能各方面均优于先前的设计。 相似文献
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量子元胞自动机(QCA)是一种纳米范围内不含晶体管的计算范例。基于QCA提出了QCA奇偶校验系统电路的分块设计方法。首先设计了异或门、奇偶判断单元,再运用分块设计思想构建了奇数产生电路和奇偶校验电路的结构,所设计的电路拥有尺寸极小和功耗极低等优点,QCADesigner软件仿真结果验证了设计的有效性。 相似文献
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量子全加器构造的探讨 总被引:1,自引:0,他引:1
本文探讨了由Toffoli门和受控非门等量子逻辑门构成低位输入、低位输出的量子全加器的电路,并分析了该种量子全加器的变换操作。通过比较推导出有多位输入、多位输出量子全加器的电路组合规律. 相似文献
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全加器是算术运算的基本单元,提高一位全加器的性能是提高运算器性能的重要途径之一。首先提出多数决定逻辑非门的概念和电路设计,然后提出一种基于多数决定逻辑非门的全加器电路设计。该全加器仅由输入电容和CMOS反向器组成,较少的管子、工作于极低电源电压、短路电流的消除是该全加器的三个主要特征。对这种新的全加器,用PSpice进行了晶体管级模拟。结果显示,这种新的全加器能正确完成加法器的逻辑功能。 相似文献
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量子全加器是量子计算机的基本单元,为了减少能耗,降低构造成本及物理实现难度,本文提出一种新型n位量子全加器,使用3n个CNOT(Controlled NOT)门和2n-1个Toffoli门实现n位量子加减法,采用超前进位方式,不含进位输入,通过最高溢出标志位判断加法的进位和减法的正负号,标志位不参与高低位计算,不增加电路延时,适合n位量子并行计算.随机生成4、8、16和32位数分别进行加减仿真操作,验证了全加器的正确性.该全加器量子代价较低,结构简单,有利于提高集成电路规模和集成度. 相似文献
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《微纳电子技术》2019,(11)
将一种电压阈值型压控双极性忆阻器模型与CMOS反相器进行混合设计,实现了"与"、"或"、"与非"、"或非"基本逻辑门。通过构建"异或"逻辑门新结构,提出一种基于混合忆阻器-CMOS逻辑的全加器电路优化设计方案。最后,分析忆阻器参数β,V_t,R_(on)和R_(off)对电路运算速度和输出信号衰减幅度的影响,研究了该优化设计的电路功能和特性,经验证模拟仿真结果与理论分析结果具有较好的一致性。研究结果表明:全加器优化设计结构更简单,版图面积更小,所需忆阻器数量减少22.2%,CMOS反相器数量减少50%;增大参数β值可提高运算速度,增大忆阻值比率R_(off)/R_(on)可减小逻辑输出信号衰减度。 相似文献
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在对现有全加器电路研究分析的基础上,提出了基于传输管逻辑的低功耗全加器。电路采用对称结构,平衡了电路延迟,消除了毛刺,降低了功耗。经PSPICE在0.24μm工艺下模拟仿真,与已发表的全加器电路的性能进行比较。测试结果表明,改进的新全加器功耗可减小77.5%,同时能耗也是最低的。 相似文献
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全加器是算术运算的基本单元,设计结构简单的全加器有利于缩小数字自理芯片的面积。根据最新的XOR门结构设计了一种新的全加器,这种结构的一位全加器只用20只MOS管,对这种新的全加器,用PSPICE进行了晶体管级模拟。结果显示,这种新的全加器能正确完成加法器的逻辑功能。 相似文献
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Scalability of Globally Asynchronous QCA (Quantum-Dot Cellular Automata) Adder Design 总被引:2,自引:0,他引:2
The concept of clocking for QCA, referred to as the four-phase clocking, is widely used. However, inherited characteristics of QCA, such as the way to hold state, the way to synchronize data flows, and the way to power QCA cells, make the design of QCA circuits quite different from VLSI and introduce a variety of new design challenges. The most severe challenges are due to the fact that the overall timing of a QCA circuit is mainly dependent upon its layout. This issue is commonly referred to as the “layout = timing” problem. To circumvent the problem, a novel self-timed circuit design technique referred to as the Locally Synchronous, globally asynchronous design for QCA has been recently proposed. The proposed technique can significantly reduce the layout–timing dependency from the global network of QCA devices in a circuit; therefore, considerably flexible QCA circuit design is be possible. Also, the proposed technique is more scalable in designing large-scale systems. Since a less number of cells is used, the overall area is smaller and the manufacturability is better. In this paper, numerous multi-bit adder designs are considered to demonstrate the layout efficiency and robustness of the proposed globally asynchronous QCA design technique. 相似文献