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相似文献
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1.
介绍了一种单端口,端口阻抗为50 Ω的S波段宽带薄膜体声波谐振器(FBAR)滤波器,该滤波器采用网格型结构的FBAR滤波器芯片级联巴伦芯片实现.对宽带FBAR滤波器芯片的设计过程、工艺实现过程进行了说明.采用0.35 μm GaAs工艺实现了3~8 GHz频率范围的巴伦芯片,在FBAR滤波器芯片的中心频率处,幅度不平衡度为0.53 dB,相位不平衡度为0.55°.制备的FBAR滤波器通带频率范围为3 100~3 400 MHz,1 dB带宽约为369 MHz,在2 660 MHz和3 840 MHz处带外抑制分别为45.6 dBc和41.3 dBc,尺寸仅为12 mm×7 mm×2.9 mm.将实测结果与仿真结果进行了对比,两者一致性很好.  相似文献   

2.
该文基于宽频枝节匹配方法提出了一种双通带薄膜体声波谐振器(FBAR)滤波器设计方法。基于S参数网络阻抗变换理论分析了滤波网络输入和输出端宽频匹配原理,设计对应于两个不同频带FBAR滤波器的阻抗匹配枝节,进而通过公共端的连接实现双通带FBAR滤波器的设计。匹配网络采用电容和电感可在基板上进行准确设计,并通过在此基板上完成FBAR滤波器的装配实现双通带滤波器的整体集成。最终设计了一种中心频率分别为2 492 MHz和6 000 MHz的双通带滤波器。结果表明,两个通带的插入损耗分别为3.29 dB和4.91 dB,阻带抑制均小于-25 dB,与理论设计结果匹配较好。  相似文献   

3.
采用完全自主的薄膜体声波谐振器(FBAR)滤波器设计、工艺技术,制备了S波段FBAR滤波器芯片。该FBAR滤波器的电路结构为梯形结构,采用一维Mason模型进行了仿真、优化。在工艺上采用空气隙型结构,突破了高c轴取向AlN压电薄膜淀积、精密空气腔制作等关键工艺技术,制备的4节FBAR滤波器中心频率为2 340MHz,3dB带宽为25MHz,中心插损为3.8dB,矩形系数达2.24∶1,输入、输出阻抗均为50Ω,芯片体积仅为1mm×1mm×0.3mm,该性能与同频率、同带宽的介质滤波器性能进行了对比,体积可缩小几千倍,矩形系数优于介质滤波器。  相似文献   

4.
该文提出了一种获得相对带宽约为70.61%的基于氮化铝薄膜的超宽带薄膜体声波谐振器(FBAR)滤波器的设计方法,即在中心频率为6.5 GHz下滤波器的带宽为4.835 GHz。仿真分析表明,通过串并联电感的方式,并在电感端串并联电容,可消除因增加电感而带来的谐波谐振点干扰对带通的影响,实现了FBAR滤波器的超宽带。该工作开辟了设计和制作带宽超过3 GHz的超宽带体声波滤波器的新途径。  相似文献   

5.
基于异构集成技术,研制了一款各通道中心频率分别为1.5,1.8,1.9和2.0 GHz的四通道高性能开关滤波器组芯片。使用了金锡凸点焊接的组装工艺,与键合线工艺相比,其互连强度更高,寄生参数更小。薄膜体声波谐振器(FBAR)滤波器芯片与微波单片集成电路(MMIC)开关电路芯片采用自主可控的FBAR工艺、 0.35μm GaAs工艺研制。为满足窄带、高矩形度、低插入损耗开关滤波器组的需求,FBAR滤波器电路采用阶梯型拓扑结构。开关电路使用串-并联混合结构,兼顾低插入损耗和高隔离度。经探针台测试结果显示,各通道中心插入损耗小于3 dB,矩形系数比约为2.0,带外抑制大于45 dBc。开关滤波器组芯片面积为4 mm×4 mm,高度约为0.4 mm。  相似文献   

6.
该文研究了一种薄膜体声波谐振器(FBAR)采用并联电感和外匹配电路的拓扑结构实现宽带滤波的方法。使用Comsol软件对FBAR进行三维结构仿真,并提取最优电极形状(变迹五边形)对应曲线到ADS中联合外匹配电路进行频带拓展,外匹配电路中的电感Ls取值直接影响滤波器带宽。经调节,最终在谐振器串联谐振频率fs=1.97 GHz,并联谐振频率fp=2.03 GHz的情况下实现了21.15%的相对带宽,此时对应的3 dB带宽为419 MHz, 1 GHz处的带外抑制为11.616 dB。  相似文献   

7.
该文设计了一款2.4 GHz WiFi频段(2 401~2 483 MHz)薄膜体声波谐振器(FBAR)滤波器。采用一维Mason电路模型,在ADS中搭建了阶梯形滤波器电路;在HFSS中建立了封装结构和测试电路有限元电磁模型,并在ADS中完成了联合仿真设计。通过微机电系统(MEMS)工艺制备与测试,滤波器在2 401~2 483 MHz频段的插入损耗≤2.2 dB。在2 520~2 900 MHz处,带外抑制≥40 dB,滤波器体积仅1.1 mm×0.9 mm×0.65 mm。  相似文献   

8.
介绍了一种适用于三维堆叠的凸点式晶圆级封装的小型化C波段宽带薄膜体声波滤波器的设计方法,并进行了工艺验证。通过对压电层薄膜进行钪掺杂、材料参数提取、结构模型优化实现了相对带宽大于5%的薄膜体声波滤波器设计。通过表面硅基微机电系统(MEMS)工艺制备与凸点式晶圆级封装实现滤波器制备。研制出标称频率5 800 MHz、插入损耗小于2.8 dB、阻带抑制大于40 dBc、体积仅1.0 mm×1.0 mm×0.35 mm的C波段宽带薄膜体声波滤波器。  相似文献   

9.
薄膜体声波谐振器(FBAR)是优良的射频频率器件.用基本Mason模型对FBAR器件进行建模,并分析阐述了FBAR射频滤波器的结构和设计方法.在此模型和设计方法基础上,对多输入多输出(MIMO)的1900MHz个人通信服务(PCS)频段和800 MHz蜂窝(Cellular)频段终端的FBAR射频多工滤波器进行了设计和性能分析.滤波器用ADS软件进行仿真和优化,仿真结果表明,本设计比Avago公司主流产品ACFM-7101性能要好,特别是带内纹波.  相似文献   

10.
薄膜体声波谐振器(FBAR)是性能优良的压电换能器.通过在体硅刻蚀型FBAR背面密封空气的方法制作了密封空气型FBAR,研究了密封空气型FBAR用作温度传感器的可行性.实验结果表明,在20~100℃的温度范围内,密封空气型FBAR温度传感器的并联谐振频率随温度线性变化,且具有很好的稳定性与可靠性.  相似文献   

11.
研制了一种以SiO2材料作为温度补偿层的S波段温度补偿型薄膜体声波谐振器(FBAR)窄带滤波器.研究了SiO:层厚度对FBAR温度漂移特性的影响,对不同厚度SiO:层时的温度补偿特性进行了仿真.仿真结果表明,当Mo/AlN/Mo的厚度为0.15,1.35和0.15 μm,SiO2层的厚度为10 nm时,FBAR的频率温度系数(TCF)约为3×10-6/℃.采用MEMS工艺制备了温度补偿型FBAR滤波器芯片并进行了测试.测试结果表明,滤波器的中心频率为2 492 MHz,中心插损为3.74 dB,3 dB带宽为17 MHz,相对带宽为0.68%,在2 477和2 507 MHz处阻带抑制分别为27.44和33.81 dBc.在三温(常温25℃、高温85℃、低温-55℃)对该滤波器的S参数进行了测试,计算得出频率温度系数为5×10-6/℃.与未加入温度补偿层的传统滤波器相比,频率温度系数改善明显.  相似文献   

12.
该文介绍了一种单端口、端口阻抗50Ω的S波段薄膜体声波谐振器(FBAR)陷波器,其采用了梯形拓扑结构与外围匹配电路相结合的方式.对FBAR陷波器芯片的设计过程、工艺实现进行了说明.测试制备的FBAR陷波器,其陷波频段为2399~2412 MHz,陷波抑制达35 dBc;通带频率分别为1800~2300 MHz和2500...  相似文献   

13.
虽然全球手机市场仍然以每季单位数字的速度增长,智能手机的出货量却持续激增,随着新一代手机的推出,智能手机可以在不需要大幅度增加尺寸和重量的条件下持续提供更多的功能,这些新产品的背后动力来自于新的移动通信网络,如4G和LTE技术的推出,大多数人已经把具有更快下载速度和更佳移动互联网体验与最新服务画上等号,正如预期,  相似文献   

14.
基于薄膜体声波谐振器(FBAR)技术的滤波器频率温度系数为(-30~-25)×10-6/℃,其电学性能受环境温度影响较大,将降低滤波器在全温工作的性能,限制其应用环境,尤其是对滤波器通带插损与矩形系数要求高的应用场合。该文在常规FBAR滤波器中引入正温度系数的SiO2材料层,通过对滤波器的层叠位置设计及加工工艺等技术的研究,研制出S波段温补型FBAR滤波器器件,其工作频率为3.1 GHz,插入损耗为2.0 dB,带外抑制不小于30 dB,频率温度系数为-0.02×10-6/℃。  相似文献   

15.
该文研制了一种晶圆级封装(WLP)的C波段薄膜体声波谐振器(FBAR)滤波器。采用一维Mason等效电路模型对谐振器进行设计,并使用HFSS对电磁封装模型进行优化,再在ADS中对滤波器进行仿真优化设计,得到阶梯型结构的FBAR滤波器。采用空腔型结构并制备出FBAR滤波器芯片,同时利用覆膜工艺对FBAR裸芯片进行覆膜和电镀等WLP工艺,得到WLP的FBAR器件。测试结果表明,滤波器的中心频率为6.09 GHz,中心插损为2.92 dB,通带插损为3.4 dB,带宽为112 MHz,带外抑制大于40 dB。  相似文献   

16.
A switchable thin film bulk acoustic wave resonator (FBAR) filter based on barium titanate (BTO) thin films is reported for the first time. BTO is a ferroelectric material which possesses electrostriction, giving the filter the ability to be placed in either an on state or an off state by changing the applied dc bias voltage. A 1.5 stage ladder type bandpass filter using BTO FBARs has been designed, fabricated, and measured. The application of a 15 V dc bias results in the filter being place in an on state with a center frequency of 2.14 GHz, a 40 MHz bandwidth and 6.2 dB of insertion loss. Conversely, the application of a $-$ 3 V dc bias results in the filter being placed in an off state with 15 dB of rejection. This filter is very compact with dimensions of 40 $mu{rm m}$ by 80 $mu{rm m}$.   相似文献   

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