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基于绝缘体硅(SOI)0.35μm工艺实现了一款满足IEEE 1596.3和ANSI/TIA/EIA-644工业标准的低压差分信号(LVDS)驱动器芯片。全芯片分为预驱动模块、输出驱动模块、共模反馈模块、使能模块和偏置模块。提出了一种具有低输入电容输出驱动模块电路结构,经仿真验证可有效降低LVDS预驱动模块30%的功耗,同时降低29%的信号延时。芯片利用共模反馈机制控制输出信号的共模电平范围,通过环路补偿保证共模反馈电路的环路稳定性。芯片使用3.3 V供电电压,经Spice仿真并流片测试,输出信号共模电平1.23 V,差分输出电压347 mV,在400 Mbit/s数据传输速率下单路动态功耗为22 mW。 相似文献
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设计了一种应用于低压差线性稳压器(LDO)的低功耗带隙基准电压源电路。一方面,通过将电路中运放的输入对管偏置在亚阈值区,大大降低了运放的功耗;另一方面,采用零功耗的启动电路,进一步降低了整体电路的功耗。该基准电压源采用旺宏0.35μm CMOS工艺流片,经测试,基准输出电压的温度系数为33 ppm/℃,总电流消耗仅为12μA。 相似文献
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设计了一种片上集成的高精确度、低功耗、无片外电容的低压差线性稳压器(LDO)。采用一种新型高精确度、带隙基准电压源电路降低输出电压温漂系数;采用零功耗启动电路和支路较少的摆率增强模块降低功耗,该电路采用CSMC 0.5 μm CMOS工艺。经过Cadence Spectre仿真验证,输出电压为3.3 V,在3.5~5.5 V范围内变化时,线性调整率小于0.3 mV/V,负载调整率小于0.09 mV/mA,输出电压在-40~+150 ℃范围内温漂系数达10 ppm/℃,整个LDO消耗17.7 μA的电流。 相似文献
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此次研究提出了低压CMOS LDO稳压电路电流优化设计流程,现有稳压电源电路与传统的CMOS LDO稳压电流电路相比较而言,低压CMOS LDO引入了低压带隙基准电路。确保在分解该稳压电源电路的设计过程中,构建完整的电源电路设计框架,在完成低压带隙基准电路分析之后,提出优化设计方案。通过具体的电路仿真,得出仿真优化结果。 相似文献
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《固体电子学研究与进展》2013,(6)
提出了一款基于标准0.18μm CMOS工艺的低噪声高电源抑制比(PSRR)CMOS低压差线性稳压器(LDO),其中包括了带隙基准电路。对LDO和带隙基准电路的噪声和电源抑制进行了建模分析,并得出了电路设计原则。根据设计原则使用两级误差放大器实现了低噪声高电源抑制性能,并且通过合理的频率补偿保证了电路稳定。测试结果显示,LDO输出在-40120℃温度范围内的温度系数约为48×10-6/℃;在1120℃温度范围内的温度系数约为48×10-6/℃;在1100kHz频率范围内输出噪声电压约为37.3μV;在1kHz和1MHz处的PSRR分别大于60dB和35dB;芯片总面积约为0.27mm2,无负载电流约为169μA。 相似文献
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针对传统片外电容型LDO噪声较差的问题,基于180nm BCD工艺,设计了一款具有折返电流限保护功能的低噪声LDO电路。基准与误差放大器间插入一阶RC低通滤波器,可滤除基准输出高频噪声,并取消传统LDO电路中的反馈电阻,从而降低噪声。通过折返电流限保护电路实现限流和折返功能。合理设置短路电流,有效避免LDO在启动或恢复过程中进入锁定状态。仿真结果表明,LDO在输入电压为4~5V时可稳定输出2V电压,最大带载电流为70mA,过流限为120mA。典型情况下的噪声功率谱在1kHz处为12.7nV/■,RMS噪声为3.6μV。 相似文献
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该文设计了一种应用于CMOS带隙基准的软启动电路,使电压基准能够快速、稳定地启动,并在其达到1V左右时自动关闭,对基准电路不产生影响,从而实现了软启动功能。采用Hynix0.5μmCMOS工艺和Hspice软件进行仿真后表明,设计的电路满足设计指标要求,具有优良的性能。 相似文献
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设计了一种应用于集成稳压器的高精度带隙基准电压源电路。采用共源共栅电流镜结构以及精度调节技术,有效提高了电压基准的温度稳定性和输出电压精度。经Hynix 0.5μm CMOS工艺仿真验证表明,在25℃时,温度系数几乎为零,基准电压随电源电压变化小于0.1 mV;在-40~125℃温度变化范围内,基准电压变化最大4.8 mV,满足设计指标要求。 相似文献
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随着CMOS图像传感器(CIS)的广泛应用,低功耗、高集成化、高稳定性成为其发展趋势,低压差线性稳压器(LDO)因体积小、功耗低、噪声低及电源抑制比高等优点而满足芯片供电需求.为了避免传统电源在芯片异常时仍持续工作致使功耗增加或芯片烧毁,设计了一种可应用于CMOS图像传感器的LDO电路,并加入了LDO的保护电路结构.该保护电路具有欠压保护与过流保护的功能,并能够通过数字电路对LDO进行使能控制.基于0.11 μm CMOS工艺平台对LDO及其保护电路进行仿真与分析,完成了该工艺下电路版图的绘制和验证. 相似文献
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基于CMOS工艺的低噪声高稳定性LDO的设计 总被引:2,自引:0,他引:2
介绍了一种LDO线性稳压器电路,给出了基本结构及其工作原理.重点分析了产生噪声的原因以及用旁路滤噪电路实现低噪声、用内部动态补偿电路实现高稳定性的电路结构和性能特点,针对输出短路或者负载电流过大设计了过流保护电路.整个电路采用HYNIX 0.5μm CMOS工艺实现,基于HSPICE进行仿真验证,输出噪声为1 μV(rms),典型环路增益为60 dB,相位裕度65°,证明了稳压器的低噪声和高稳定性. 相似文献
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介绍了基于SOI CMOS工艺平台的FPGA电路的设计;结合FPGA电路自身的特点,对电路从标准体硅CMOS工艺迁移到SOI CMOS工艺过程中,在逻辑、版图以及可靠性等方面所作的分析和实践进行了总结。 相似文献
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文中提出了一种基于动态频率补偿技术的LDO电路。通过添加电压缓冲器,提高了LDO的环路增益和瞬态响应特性。该电路通过电流镜采样调整管电流,使主极点频率与第三极点频率随负载电流的改变而产生相同倍数的变化,克服了LDO零极点随负载变化而导致环路稳定性变差的问题。文中设计采用中电二十四所HC12.BJT工艺,利用Spectre仿真工具进行仿真,研究了不同负载电流下该LDO的频率特性及其稳定性问题。仿真结果表明,该电路在10 μA~100 mA负载电流的变化范围内,LDO环路的相位裕度保持在50°~70°之间,证明提出的LDO调整器具有良好的稳定性。 相似文献
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采用0.18μm CMOS SOI工艺技术研制加工的单刀双掷射频开关,集成了开关电路、驱动器和静电保护电路。在DC~6GHz频带内,测得插入损耗0.7dB@2GHz、1dB@4GHz、1.5dB@6GHz,隔离度37dB@2GHz、31dB@4GHz、27dB@6GHz,在5GHz以内端口输入输出驻波比≤1.5:1,输入功率1dB压缩点达到33dBm,IP3达到42dBm。可应用于移动通信系统。 相似文献
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