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为实现一种多浮点操作数乘法运算的自主运算控制器,提出了一种基于FPGA并行操作的硬连接电路的多浮点数乘法运算控制器及其时序控制的方法,该控制器对一条多浮点操作数乘法运算指令的命令字和多浮点操作数连续写入并存储,在内部时序脉冲作用下,可以自主完成读出浮点操作数执行乘法运算,写入存储多浮点操作数过程与执行乘法运算命令的过程能够并行进行;在控制器执行乘法运算命令过程中,系统可以读出执行命令过程中的中间结果和最终运算结果;论述了该控制器的电路构成和基本原理,分析命令字与多操作数在内部时序脉冲作用下的执行过程,应用Verilog HDL语言实现相关硬件的构建和连接;设计完成后通过仿真测试可知,该控制器运行的最高频率为250 MHz,从输入到输出端口最小延时是3.185 ns,最大延时是15.336 ns,且能够自主完成浮点数乘法运算。 相似文献
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在激光等离子体机理的研究中,为实现灵活的界面配置和多路脉冲激光器高精度的时序延时,设计了一种基于微控制器STM32和FPGA的多路时序延时控制系统。重点介绍了基于FPGA的多路ns级时序信号和基于ucGUI的触摸屏界面的设计。另外,采用高速光电隔离技术和高速FET开关电路技术,对驱动电路进行了设计,缩短了输出脉冲上升沿的时间,提高了系统延时精度、驱动能力和抗干扰性能。测试结果表明,该设计每路延时可调,调节范围为5 ns~10 ms,最小可调步进为5 ns,延时误差小于1 ns。 相似文献
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针对ARM+FPGA构建的PLC系统,分析PLC对定时器/计数器的功能需求,设计了可以并行执行的定时器/计数器,构建的定时器/计数器共用一个端口读写控制器与FPGA中央控制器进行数据通信,定时器/计数器内部工作是相互独立的,能够并行的工作,并通过使用地址映射存储器使得定时器/计数器的指令执行更加高效。对中央控制器与定时器/计数器的通信时序和通信格式进行了设计,方便了中央控制器对定时器/计数器的控制与测试。通过仿真测试,该定时器/计数器能够满足PLC定时器/计数器的基本功能,并且达到了稳定的定时/计数的设计要求。 相似文献
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介绍了200 kV水介质高压脉冲延时线的基本设计参数,阻抗为23.4Ω,电长度为300 ns;分析了该延时线的耐压特性,并对其传输脉冲幅度衰减率进行了估算。加工了一套高压脉冲延时线装置,并进行了实验研究。实验中,利用Blumlein线产生两路高压方波脉冲输出,一路经高压电缆-延时线-高压电缆到匹配负载,另一路经过高压电缆到匹配负载,两负载上的脉冲等效认为是延时线的输出脉冲和输入脉冲。实验结果表明,该延时线工作电压大于200 kV,输入方波脉冲前沿为30 ns,输出方波脉冲前沿增加到34.5 ns,方波脉冲幅度损耗率为1.8%。 相似文献
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针对加速器驱动次临界系统(ADS)注入器Ⅱ的控制中对于同步触发信号的要求,设计了基于现场可编程门阵列(FPGA)的高精度同步控制器,它能为加速器设备提供同步工作所需的脉冲信号。控制器采用粗延时结合精延时的方式,FPGA实现粗延时,专用延时芯片实现精延时,提高了延时精度,同时增大了延时、脉宽及周期的调节范围。测试结果表明,该控制器输出脉冲的最小延时步距为0.25ns,延时、脉宽及周期调节范围为1μs~2s,周期抖动的标准偏差为70ps。该控制器输出信号满足要求,程序界面操作简便,通过串口RS-422远程控制稳定可靠。 相似文献
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为了满足脉冲电场消融的应用需求,解决单极性脉冲电场分布不均匀的问题,研制了一台基于半桥结构的主电路、具有纳秒级前沿的高重复频率双极性亚微秒高压脉冲电源。该脉冲电源由FPGA提供控制信号,经过驱动芯片放大控制信号后,利用光耦隔离驱动多个SiC MOSFET。驱动电路所需元器件较少,信号控制时序简单,可提供负压偏置,使开关管可靠关断,提高了电路的抗电磁干扰能力,使电源能稳定运行。通过电阻负载实验,对比分析了不同栅极电阻对驱动电压的影响,驱动电压上升沿时间越短对应的双极性高压脉冲前沿越快。实验结果表明:所设计的高频双极性脉冲电源在100Ω纯阻性负载上能够稳定产生重复频率双极性纳秒脉冲,输出电压0~±4 kV可调,脉宽0.2~1.0μs可调,正负脉冲相间延时0~1 ms可调,上升沿和下降沿60~150 ns之间。该双极性脉冲电源电路设计结构紧凑,能满足应用的参数需求。 相似文献
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