| 多端口存储器控制器IP核的设计与实现 |
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| 引用本文： | 王力纬,曹阳,朱小虎,李晓辉.多端口存储器控制器IP核的设计与实现[J].武汉大学学报(理学版),2007,53(5):617-621. |
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| 作者姓名： | 王力纬 曹阳 朱小虎 李晓辉 |
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| 作者单位： | 1. 武汉大学,电子信息学院,湖北,武汉,430072
2. 武汉大学,电子信息学院,湖北,武汉,430072;武汉大学,软件工程国家重点实验室,湖北,武汉,430072 |
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| 基金项目： | 国家高技术研究发展计划(863计划);高等学校博士学科点专项科研项目 |
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| 摘 要： | 提出了一种通用的多端口存储器控制器的设计与实现方案,该方案采用AMBA（advanced microcon-troller bus architecture）总线,最多可支持6个AHB（advanced high-performance bus）主设备同时访问存储器;支持包括SRAM、ROM、NOR-FLASH、SDR-SDRAM、DDR-SDRAM在内的多种存储器;内部设计实现的仲裁器采用固定优先级和TimeOut机制相结合的仲裁策略.基于SMIC 0.13μm CMOS工艺库,芯片面积约为230653μm2,系统时钟为130 MHz.FPGA验证结果表明：该方案实现的存储器控制器能够充分利用存储器的带宽,提高系统的性能.
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| 关 键 词： | 存储器控制器 先进微控制器总线结构 知识产权核 多端口存储器控制器 |
| 文章编号： | 1671-8836（2007）05-0617-05 |
| 修稿时间： | 2007-02-05 |
Design and Implementation of Multi-Port Memory Controller IP Core |
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| WANG Liwei,CAO Yang,ZHU Xiaohu,LI Xiaohui.Design and Implementation of Multi-Port Memory Controller IP Core[J].JOurnal of Wuhan University:Natural Science Edition,2007,53(5):617-621. |
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| Authors: | WANG Liwei CAO Yang ZHU Xiaohu LI Xiaohui |
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| Institution: | 1. School of Electronic Information, Wuhan University, Wuhan 430072, Hubei, China; 2. State Key Laboratory of Software Engineering, Wuhan University, Wuhan 430072, Hubei, China |
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