比较逻辑与异步触发时序电路的分析和综合

本文从触发器的完整状态方程出发,研究了异步触发时序电路的分析与综合的新方法,提出了触发器的α跃变、β跃变行为可用比较运算中的小于、大于运算表示,而各触发器的α跃变、β跃变之间的覆盖关系则可用大于等于运算进行检验。在此基础上提出了适用于使用计算机的异步触发时序电路的分析和综合程序。     

Preliminary Design of BES-Ⅲ Trigger System

This article desribes the preliminary design of the trigger system for the updating beijing Spectrometer at Beijing Electron Pstiron Collider,including,backgrounds study ,event estimation,new techniques like pileline to be used in the trigger,and the principle and consideration in the trigger design.     

低功耗互补传输门绝热逻辑和时序电路的设计

研究了采用二相非交叠功率时钟的绝热触发器及时序电路的设计，介绍了采用二相无交叠功率时钟的互补传输门绝热逻辑（CPAL）电路，并分析了其工作原理．该电路利用nMOS管自举原理对负载进行全绝热驱动，从而减小了电路整体功耗，且CPAL能耗几乎与工作频率无关．提出了性能良好的低功耗绝热D、T和JK触发器，并与其他几种绝热触发器进行功耗比较．给出了绝热时序电路的一般设计方法，并作为实例采用应用绝热D触发器设计了十进制计数器．SPICE程序模拟表明：设计的电路具有正确的逻辑功能及低功耗的优点．     

不对称卟啉共价固载于硅基介孔薄膜材料模拟RS触发器的研究

合成了5-(4-氨基苯基)-10,15,20-三苯基卟啉(ATPP),并成功将其以共价嫁接的形式固载于介孔二氧化硅薄膜。基于卟啉化合物对酸碱的特异性响应,实现了对RS触发器逻辑功能的模拟。卟啉化合物被共价固载于介孔薄膜材料使得该分子逻辑器件具有相对较大的表面积、周期性排布的均一孔道结构以及高的光透过性等介孔薄膜材料的优异性质。这种混合多孔结构不但有利于嫁接于介孔材料中的卟啉与酸碱的更有效相互作用,而且还使酸碱输入能够被更加彻底地清除。     

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针对HL-2A装置极向场电源晶闸管触发器系统同步信号波形畸变严重、频率不断变化的特点,通过分析和比较各种滤波器的滤波效果,提出了一个多级数字滤波器联合滤波的方案。利用MATLAB软件搭建了该滤波器的仿真模型,并对其进行了仿真分析,理论上证明了该方案的可行性。通过估计算法的延时,证明了该数字滤波器满足实时信号处理的要求。     

基于低功耗双边沿D触发器的任意进制异步计数器设计

从D触发器激励表入手，分别给出了采用单边沿D触发器和双边沿D触发器的2^n进制异步加法计数器、减法计数器的设计方法．在此基础上，采用逻辑函数修改技术，通过实例讨论了基于单边沿D触发器和双边沿D触发器的异步任意进制计数器的设计．该设计方法方便，快速，具有一定的实用意义．     

基于多阈值技术的低功耗D触发器设计

目前CMOS电路中,漏电流功耗已经成为不可忽视的部分.降低电路漏电流功耗的一种有效方法是采用多阈值电路技术.根据多阈值电路设计原理,电路的关键路径采用低阈值晶体管,以保证电路的性能;非关键路径采用高阈值晶体管,以降低电路的漏电流功耗.对于触发器来说,其对时钟的响应部分是一个关键路径,而对信号的响应部分是非关键路径.本文据此设计了一种新型低功耗D触发器--多阈值与非门保持型D触发器.该电路结构简单,降低了电路漏电流功耗,并且当输入保持不变时,时钟信号不作用于内部结点,使内部结点电压保持不变,这进一步降低了电路的功耗.模拟结果表明所设计的D触发器跟传统的D触发器相比,可节省近25%的功耗.     

定量脉冲产生电路

采用CMOS数字集成电路设计了特殊的脉冲电路，该电路能够根据设定输出指定数目的脉冲。     

四值单稳态触发器设计

在二值单稳态触发器设计的基础上，提出了四值单稳态触发器的设计方案．经过PSPICE模拟，所设计的电路具有正确的逻辑功能，并能由此方法推广到基值更高的单稳态触发器的设计．与二值单稳态触发器相比，四值单稳态触发器具有更强的功能．     

BEPCⅡ束团缺口信号的提取

 基于隧道二极管单稳态电路、高速可重触发电路、ECL技术等多种高速电路技术设计了BEPCⅡ束团缺口信号提取电路。介绍了BEPCⅡ储存环中带缺口的多束团运行模式。对Pickup电极感应信号经过长电缆传输衰减后的波形进行了研究。分析了缺口提取电路中处理快速信号的隧道二极管单稳态电路原理，该电路可以将0.3 ns的正脉冲展宽到4 ns的ECL电平脉冲。给出了标准束团注入和非标准注入情况下束团缺口判定逻辑。测试结果表明:此电路对各种束团注入情况均能正常工作，且提取出的同步信号均方根抖动值仅为80.49 ps，满足设计要求。